赛灵思领先一步推出Vivado设计套件，取得重大突破
新增自动化 ultrafast 设计方法和 opencl 硬件加速功能，可有效加速7系列和 ultrascale器件的运行，提供更佳的qor和更强大的opencl内核支持，并实现自动化的ultrafast设计方法。
all programmable技术和器件的全球领先企业赛灵思公司今天宣布推出vivado设计套件，这是业界唯一一款soc增强型开发环境。该版本增加了ultrafast设计方法的自动化功能，让所有器件的运行时间平均缩短达25%，性能提升5%。此外，还在vivado hls（高层次综合)中新增了opencl内核硬件加速功能。
目前已有2,500多家客户接受了ultrafast设计方法的培训，ultrafast设计方法视频教程也有30,000次观看。赛灵思将不断提高该设计方法的知名度和采用度，旨在提高设计人员的生产力。用ultrafast设计方法，设计团队可将设计收敛从此前的数月缩短到数周。
现在全新第二版本vivado设计套件中的ultrafast设计方法，新增了vivado对 28nm 7系列和20nm ultrascale 器件的支持。ultrascale架构在全面可编程架构的基础上采用业界领先的asic技术，实现了数百gbps的系统级性能，能以各种线路速率智能处理，从而将速率扩展到了tb甚至tflop级水平。新版设计方法还包括使用了cadence、mentor graphics和synopsys流程的高层次综合、部分重配置以及验证工具。
增强工具功能
用ultrafast设计方法是提高生产力的最佳实践方法，关键在于是否用正确的方法来制定设计约束以加快时序收敛。利用最新发布的交互式时序约束向导，vivado设计套件版能自动生成“生成即保证正确”的约束。该向导内置的智能功能可通过查询vivado设计数据库，抽取时钟结构和通常来源于ip重用的现有约束，然后指导用户正确约束设计其它部分。
vivado设计套件 版本还配套推出了最新赛灵思tcl商店，设计人员可自行发布和分享合格脚本，用以执行有用功能并提高生产力。在vivado集成设计环境中即可可访问tcl商店，该商店提供有开源脚本库，设计人员使用这些脚本执行的功能可扩展vivado设计套件的核心功能，而工具专家则能分享代码，以提高更大用户群的设计效率。今天宣布推出的tcl应用能提供定制报告、分析、优化、工具流程控制和各种设计修改。
vivado高层次综合
vivado hls目前用于无线、医疗、国防和消费类等应用的高级算法中，用于加速ip创建、它可让赛灵思all programmable器件直接运用c、c++和system c规范，无需手动创建rtl。vivado ip integrator和vivado hls结合使用能大幅降低开发成本，相对于rtl而言能降低多达15倍。
随着vivado设计套件版的推出，vivado hls现在能为opencl内核提供早期试用支持。opencl为编写在不同异构平台上执行的内核提供了框架和语言，现在能无缝转换为运行于赛灵思all programmable器件上的ip。此外，vivado设计套件版借助最新线性代数库还可将vivado hls扩展用于各种信号处理应用，从而快速生成c/c++算法ip，满足cholesky分解、奇异值分解(svd)、qr因式分解和矩阵乘法等函数需求。
供货情况
即日起，用户即可登录：china.xilinx.com/download，下载vivado设计套件版本。所有 赛灵思sdk (软件设计套件)和赛灵思ip软件相关更新， 请参考相关 发布说明。 另欢迎注册观看vivado设计套件在线培训课程，充分利用ultrafast设计方法和基于vivado设计套件的目标参考设计，快速提高设计生产力。
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目前已有2,500多家客户接受了ultrafast设计方法的培训，ultrafast设计方法视频教程也有30,000次观看。赛灵思将不断提高该设计方法的知名度和采用度，旨在提高设计人员的生产力。用ultrafast设计方法，设计团队可将设计收敛从此前的数月缩短到数周。
现在全新第二版本vivado设计套件中的ultrafast设计方法，新增了vivado对 28nm 7系列和20nm ultrascale 器件的支持。ultrascale架构在全面可编程架构的基础上采用业界领先的asic技术，实现了数百gbps的系统级性能，能以各种线路速率智能处理，从而将速率扩展到了tb甚至tflop级水平。新版设计方法还包括使用了cadence、mentor graphics和synopsys流程的高层次综合、部分重配置以及验证工具。
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