n沟道FET晶体管箝位原理图
max4885e的ddc开关还为此类应用提供了一个附加功能：电压箝位。来自显示器的ddc电压通常通过2.2kω电阻上拉到+5v (图2)。ddc驱动器不允许出现如此高的电压，一般只允许最大+3.3v的电压。ddc信号兼容于i²c标准，开关两侧都有上拉电阻。开关本身由一对n沟道晶体管组成。
图2. n沟道fet晶体管箝位原理图
由于体二极管的影响，n沟道fet只能通过约0.7v以内的栅极电压。当电压接近栅极电压时，由于偏置电压不够大，沟道电阻增大。而开关两侧均上拉到各自的供电电压时，n沟道几乎完全箝位。可以传输接近地电位的信号，开关很容易下拉。如果+5v侧信号范围为：0.5v至4.8v，则3.3v侧的信号摆幅为0.5v至3.3v，如上图(左侧)。
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图2. n沟道fet晶体管箝位原理图
由于体二极管的影响，n沟道fet只能通过约0.7v以内的栅极电压。当电压接近栅极电压时，由于偏置电压不够大，沟道电阻增大。而开关两侧均上拉到各自的供电电压时，n沟道几乎完全箝位。可以传输接近地电位的信号，开关很容易下拉。如果+5v侧信号范围为：0.5v至4.8v，则3.3v侧的信号摆幅为0.5v至3.3v，如上图(左侧)。
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