基于高线性混频器MAX9994实现侦测接收通道的设计方案
随着全球3g网络的大规模建设，运营商越来越注重降低capex（建设成本）和opex（维护成本），功放作为基站当中最昂贵的器件之一，其对效率的要求越来越高，从而使得数字预失真dpd（digital pre-distortion）技术得到飞快的发展。图1是功放数字预失真处理的基本结构框图。和模拟预失真以及前馈架构相比，数字预失真在提高效率、多载波应用、修正效果以及自适应方面具有很大的优势。同时随着零中频架构开始在3g基站中得到应用，数字预失真在修正零中频架构中的本振泄漏和镜像抑制方面， 具有非常好的效果。 但是要实现这些优势和取得良好的预失真效果，一个高性能的侦测接收通道是必须的，本文旨在对侦测接收回路的设计做一些具体讨论。
图2是maxim提供的一个紧凑而低成本的侦测接收通道设计方案。此方案采用高线性混频器max9994将rf信号下变频到if信号， 然后经过if滤波器滤波， if滤波采用50ω的单端设计以降低滤波器对pcb板寄生分量的敏感度。滤波器输出的if信号经可变增益中频放大器max2055调整增益， 然后以极佳的线性度驱动adc的输入。此方案的设计讨论是基于w
cdma、4载波、40w功放、每载波10w、5阶失真侦测。表1是相关的基本设计参数。对于更少的载波和更低阶的失真监测也可以采用同样的架构， 主要是测量带宽的要求有所不同。对于不同功率的功放， 主要差异表现在lo-rf泄漏。
射频信号耦合
从功放射频输出耦合过来的信号功率必须要降低到适合混频器输入级要求的功率水平， 这可以采用定向耦合加固定衰减的方式。如果需要的话， 加入射频可变衰减器以补偿链路增益变化。加到此处混频器合适的射频输入功率为-22dbm， 所以对于每载波10w， 40dbm的功放输出功率， 这里需要62db的衰减量。
混频器max9994的本振到射频的泄漏典型值为-17dbm，此泄漏同样会被射频衰减器和耦合器再衰减， 所以经过62db的衰减后， 功放输出端的lo-rf 泄漏小于-79dbm。umts要求在大于60mhz的偏移范围内杂散辐射低于-73dbc， 图2的解决方案可以不需要任何射频带通滤波器就可以有很宽的余量满足这个指标。如果需要更宽的余量， 可以采用一个简单的陶瓷射频滤波器以进一步降低本振泄漏分量。
adc及中频频率的选择
对于4载波wcdma， 5阶失真校正， 结合下面的图3， 我们可以计算出载波带宽和谐波修正带宽如下：
载波带宽bw = 45mhz = 20mhz
五阶谐波修正带宽bw = 520mhz = 100mhz
由此可以推荐使用如下系列的adc：
10位， 170msps~250msps adc
-max1122-1124
12位，170msps~250msps adc
-max1213-1215
下变频if频率的选择是一个折中和平衡的过程， 较低的中频频率可以最小化离散l-c中频滤波器寄生分量的影响；如果用到射频滤波器， 较高的中频频率可以降低对rf滤波器选择性的要求。上面推荐的adc在任何小于250mhz的中频频率下都可以很好的工作。 4载波wcdma功放数字预失真的操作， 对于170msps~244msps的采样频率， 我们假定adc工作在第一或者第二奈奎斯特域， 建议中频的中心频率在61mhz或者183mhz。对于更加受限的带宽和采样率， 也可以尝试采用65msps ~95msps adc， 工作在第四或者第五奈奎斯特域。
针对数字预失真处理当中的侦测接收回路设计，maxim提供了几个管脚兼容的adc系列。其中一个系列可以提供8位，10位和12位的分辨率，120msps，170msps，210msps和 250msps的采样率， 见表2。所有这些adc都针对高至250mhz的输入频率做了性能优化设计，在这样高的输入频率下，它们保持着极高的噪底、sfdr和imd性能。这对侦测接收应用是最佳选择，因为侦测接收需要在非常宽的输入带宽内提供高精度的数字化处理。
maxim也提供12位和14位，采样率65msps，80msps和 95msps的针对两载波应用的adc，两载波应用中失真的侦测需要较少的带宽。表2列出了maxim为侦测接收应用推荐的典型adc型号。
混频
混频器max9994为多载波应用提供出色的线性度和噪声性能，同时提供更高的集成度，该器件包含双平衡无源混频器内核、if放大器、双输入lo可选开关和lo缓冲器，它还集成了片上非平衡变压器，允许单端rf和lo输入。 -3dbm ~ +3dbm低lo驱动可以降低系统对本振源驱动能力的要求。max9994的中频输出是具有200ω源阻抗的差分输出。
图4是max9994在1， 2和 4载波wcdma应用中的邻道泄漏比aclr性能曲线。结合紧随其后的中频放大器的aclr，混频器71dbc的aclr预算会给所要求的功放性能水平以足够的余量， 这确保了侦测接收通道的线性度，从而不会影响整个闭环回路的性能。对于4载波操作，根据图4中对应的4载波曲线， 71dbc的aclr要求每个载波的输入功率水平在-22dbm，较少的载波或者较宽松aclr要求的应用可以允许更高一些的功率水平。
中频滤波与中频放大
max9994的输出通过一个4:1非平衡变压器耦合进一个单端 50ω阻抗的中频滤波器。在这里， 客户可以选择低通或者是带通滤波器。maxim设计和仿真了一个简单的4极高通和4极低通层叠的，中心频率在183mhz的滤波器，lc元器件取值在 9pf~23pf和 24nh ~ 100nh的范围，这些值和pcb板的寄生参数比较接近。滤波器阻抗比较低的话，可以降低对pcb板寄生电容所引起变化的敏感性，这里的pcb布线要尽量短。
混频器max9994的输出信号为达到adc输入水平的要求而需要放大，中频可变增益放大器max2055可以在保持良好线性的情况下提供这种增益。图4演示了在1，2和4
载波wcdma应用当中，输出功率与max2055的aclr指标之间的关系。
结合前面混频器的aclr，71dbc的aclr目标最终合成一个69dbc的中频放大器aclr指标， 对于4载波操作，根据图5中对应的4载波曲线， 69dbc aclr要求每个载波的输出功率－4dbm。对于更少的载波数量，可以获得更高的aclr。
如图2中所示， 经过max9994和中频滤波器以后的信号水平大概在-16dbm每载波。因为max2055的增益可以在-5db~+20db的范围内以1db间隔进行设置，所以用户可以选择合适的增益设置， 以驱动adc到-4dbm每载波。同时max2055允许用户补偿链路当中耦合器和rf衰减器产生的增益变化。
adc输入输出结构
max2055的输出经电容耦合进终结adc输入的50ω差分阻性负载。低的源阻抗可以最小化adc输入阻抗的影响。
adc max1124和max1215n的满量程输入幅度是1.4vp-p。假定wcdma波形的峰均比是10db，并且假设adc至少有1db的裕量在工作，这将使得adc输入端的rms信号幅度大概在200mv。对于50ω的阻抗系统， 相当于每载波-4dbm的输入功率水平， 这与前面的中频放大器max2055 的输出驱动水平是一致的。
前面提到的adc都是采用lvds输出结构，这对支持高采样率是必须的，在侦测接收应用当中尤其重要，而且adc的imd性能要求非常的严格。老一点的接口技术，像cmos，会引入较高的数字信号回流到adc的地平面。对于10位和12位性能水平，这个回流会与adc输入和输入滤波器件结合，给模拟输入信号引入误差。maxim adc所采用的低摆幅的差分lvds输出结构可以去除这些潜在的失真源。侦测回路本身的任何失真，都将直接加入到功放的失真，所以必须最小化。
噪底
图2的方案框图中标识了通道中各级的噪底指标。可以看出， 噪底指标主要受控于所选adc的snr性能， 和10位adc相比， 12位的ad转换器可以提供非常明显的更佳性能。3gpp umts的噪底规范是在50mhz偏移处-138dbc/hz， 用户必须检查失真校正回路的噪声灵敏度以决定所需要的adc噪底性能。
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图2是maxim提供的一个紧凑而低成本的侦测接收通道设计方案。此方案采用高线性混频器max9994将rf信号下变频到if信号， 然后经过if滤波器滤波， if滤波采用50ω的单端设计以降低滤波器对pcb板寄生分量的敏感度。滤波器输出的if信号经可变增益中频放大器max2055调整增益， 然后以极佳的线性度驱动adc的输入。此方案的设计讨论是基于w
cdma、4载波、40w功放、每载波10w、5阶失真侦测。表1是相关的基本设计参数。对于更少的载波和更低阶的失真监测也可以采用同样的架构， 主要是测量带宽的要求有所不同。对于不同功率的功放， 主要差异表现在lo-rf泄漏。
射频信号耦合
从功放射频输出耦合过来的信号功率必须要降低到适合混频器输入级要求的功率水平， 这可以采用定向耦合加固定衰减的方式。如果需要的话， 加入射频可变衰减器以补偿链路增益变化。加到此处混频器合适的射频输入功率为-22dbm， 所以对于每载波10w， 40dbm的功放输出功率， 这里需要62db的衰减量。
混频器max9994的本振到射频的泄漏典型值为-17dbm，此泄漏同样会被射频衰减器和耦合器再衰减， 所以经过62db的衰减后， 功放输出端的lo-rf 泄漏小于-79dbm。umts要求在大于60mhz的偏移范围内杂散辐射低于-73dbc， 图2的解决方案可以不需要任何射频带通滤波器就可以有很宽的余量满足这个指标。如果需要更宽的余量， 可以采用一个简单的陶瓷射频滤波器以进一步降低本振泄漏分量。
adc及中频频率的选择
对于4载波wcdma， 5阶失真校正， 结合下面的图3， 我们可以计算出载波带宽和谐波修正带宽如下：
载波带宽bw = 45mhz = 20mhz
五阶谐波修正带宽bw = 520mhz = 100mhz
由此可以推荐使用如下系列的adc：
10位， 170msps~250msps adc
-max1122-1124
12位，170msps~250msps adc
-max1213-1215
下变频if频率的选择是一个折中和平衡的过程， 较低的中频频率可以最小化离散l-c中频滤波器寄生分量的影响；如果用到射频滤波器， 较高的中频频率可以降低对rf滤波器选择性的要求。上面推荐的adc在任何小于250mhz的中频频率下都可以很好的工作。 4载波wcdma功放数字预失真的操作， 对于170msps~244msps的采样频率， 我们假定adc工作在第一或者第二奈奎斯特域， 建议中频的中心频率在61mhz或者183mhz。对于更加受限的带宽和采样率， 也可以尝试采用65msps ~95msps adc， 工作在第四或者第五奈奎斯特域。
针对数字预失真处理当中的侦测接收回路设计，maxim提供了几个管脚兼容的adc系列。其中一个系列可以提供8位，10位和12位的分辨率，120msps，170msps，210msps和 250msps的采样率， 见表2。所有这些adc都针对高至250mhz的输入频率做了性能优化设计，在这样高的输入频率下，它们保持着极高的噪底、sfdr和imd性能。这对侦测接收应用是最佳选择，因为侦测接收需要在非常宽的输入带宽内提供高精度的数字化处理。
maxim也提供12位和14位，采样率65msps，80msps和 95msps的针对两载波应用的adc，两载波应用中失真的侦测需要较少的带宽。表2列出了maxim为侦测接收应用推荐的典型adc型号。
混频
混频器max9994为多载波应用提供出色的线性度和噪声性能，同时提供更高的集成度，该器件包含双平衡无源混频器内核、if放大器、双输入lo可选开关和lo缓冲器，它还集成了片上非平衡变压器，允许单端rf和lo输入。 -3dbm ~ +3dbm低lo驱动可以降低系统对本振源驱动能力的要求。max9994的中频输出是具有200ω源阻抗的差分输出。
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max9994的输出通过一个4:1非平衡变压器耦合进一个单端 50ω阻抗的中频滤波器。在这里， 客户可以选择低通或者是带通滤波器。maxim设计和仿真了一个简单的4极高通和4极低通层叠的，中心频率在183mhz的滤波器，lc元器件取值在 9pf~23pf和 24nh ~ 100nh的范围，这些值和pcb板的寄生参数比较接近。滤波器阻抗比较低的话，可以降低对pcb板寄生电容所引起变化的敏感性，这里的pcb布线要尽量短。
混频器max9994的输出信号为达到adc输入水平的要求而需要放大，中频可变增益放大器max2055可以在保持良好线性的情况下提供这种增益。图4演示了在1，2和4
载波wcdma应用当中，输出功率与max2055的aclr指标之间的关系。
结合前面混频器的aclr，71dbc的aclr目标最终合成一个69dbc的中频放大器aclr指标， 对于4载波操作，根据图5中对应的4载波曲线， 69dbc aclr要求每个载波的输出功率－4dbm。对于更少的载波数量，可以获得更高的aclr。
如图2中所示， 经过max9994和中频滤波器以后的信号水平大概在-16dbm每载波。因为max2055的增益可以在-5db~+20db的范围内以1db间隔进行设置，所以用户可以选择合适的增益设置， 以驱动adc到-4dbm每载波。同时max2055允许用户补偿链路当中耦合器和rf衰减器产生的增益变化。
adc输入输出结构
max2055的输出经电容耦合进终结adc输入的50ω差分阻性负载。低的源阻抗可以最小化adc输入阻抗的影响。
adc max1124和max1215n的满量程输入幅度是1.4vp-p。假定wcdma波形的峰均比是10db，并且假设adc至少有1db的裕量在工作，这将使得adc输入端的rms信号幅度大概在200mv。对于50ω的阻抗系统， 相当于每载波-4dbm的输入功率水平， 这与前面的中频放大器max2055 的输出驱动水平是一致的。
前面提到的adc都是采用lvds输出结构，这对支持高采样率是必须的，在侦测接收应用当中尤其重要，而且adc的imd性能要求非常的严格。老一点的接口技术，像cmos，会引入较高的数字信号回流到adc的地平面。对于10位和12位性能水平，这个回流会与adc输入和输入滤波器件结合，给模拟输入信号引入误差。maxim adc所采用的低摆幅的差分lvds输出结构可以去除这些潜在的失真源。侦测回路本身的任何失真，都将直接加入到功放的失真，所以必须最小化。
噪底
图2的方案框图中标识了通道中各级的噪底指标。可以看出， 噪底指标主要受控于所选adc的snr性能， 和10位adc相比， 12位的ad转换器可以提供非常明显的更佳性能。3gpp umts的噪底规范是在50mhz偏移处-138dbc/hz， 用户必须检查失真校正回路的噪声灵敏度以决定所需要的adc噪底性能。
瑞芯关于防雷防静电的主板应对方案
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