sc6301
低功耗超低噪声时钟抖动消除器
sc6301是高性能时钟调节器,支持jedec jesd204b。当使用设备和sysref时钟时,pll2的14个时钟输出可配置去驱动7个jesd204b转换器或其他逻辑设备。sysref可以使用直流和交流耦合来提供。不仅限于jesd204b应用,14个输出均可单独配置为传统高性能时钟系统输出。
sc6301具有高性能、低功耗、双vco、动态数字延迟、信号丢失保持等特性。因此,sc6301是提供灵活的高性能时钟树的理想选择。
新品简介
01
主要性能
支持jedec jesd204b
超低rms抖动
76fs rms jitter (10khz到20mhz)
-162dbc/hz@245.76 mhz
pll2可提供多达14路差分时钟
最多7个sysref时钟
时钟最大输出频率3.1ghz
支持lvpecl, lvds, hsds, lcpecl等输出接口
pll1 提供一个vcxo/crystal缓冲输出
支持lvpecl, lvds, 2路lvcmos等输出接口
pll1
3个备用的输入时钟
手动切换模式
无中断切换和los
集成低噪声的晶体振荡电路
具有输入时钟丢失的保持模式
pll2
相位检测速率:=<155mhz
2路集成低噪声vco
输出支持1到32整数分频,占空比50%
高精度数字延迟,可自适应性
23ps步进模拟延迟
模式:双pll, 单pll, 时钟分布
工作温度:-40℃到85℃
工作电压:3.15v到3.45v
qfn-64封装
02
应用场景
无线基础设施
数据交换时钟
网络, sonet/sdh, dslam
医疗/视频
测量
03
功能框图
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