如何使用DMA加速低功耗可穿戴设备中的外设监控
本文介绍在嵌入式系统编程中使用直接内存访问 （dma） 的用例、优点和缺点。本文介绍了 dma 如何与外设和内存模块交互，以提高 cpu 的运行效率。本文还将向读者介绍不同的dma总线接入架构，以及每种架构的优点。
嵌入式系统的一项常见任务是管理外部输入。管理输入会给处理器带来大量不必要的计算压力，导致处于有功功率模式的时间更长，响应时间变慢。为了优化功耗、保持对事件的快速响应以及管理大型连续数据传输，具有直接存储器访问 （dma） 功能的微控制器可以提供最佳解决方案。
直接内存访问 （dma）
在涉及外设的系统应用中，微处理器在很多方面都可能成为瓶颈。例如，在管理不断发送数据的adc时，处理器可能会经常中断，以至于难以完成其他任务。dma 是一种移动数据并最大限度地减少处理器参与大型或快速数据事务的方法。您可以将 dma 控制器视为一个协处理器，其唯一目的是与内存和外设进行交互。这使得主处理器能够成功地管理贪婪的外设，专注于另一项任务，甚至在后台进行数据交易时进入睡眠状态并节省电力。例如，在 arm 架构上，dma 模块可以在 lp2（睡眠）或 lp3（运行）模式下运行。这在需要延长电池寿命的应用中具有明显的优势，例如可穿戴传感器集线器和智能手表。®
优点和缺点
dma在许多数字系统中都很有用，有时甚至需要它来管理大量的总线流量。它已被用于网卡，图形卡，甚至一些原始的ibm pc。话虽如此，将dma整合到设计中确实有一些权衡。
使用 dma 的优势
中央处理器时间 dma 最大限度地减少了对处理器执行和中断的需求， 减少数据事务所需的 cpu 时间。
功耗 如果 dma 允许处理器在 dma 传输期间休眠，则使用 dma 可以产生最小化功耗的机会。
并行操作 根据系统总线的体系结构细节，处理器可能能够在发生外设事务时执行其他操作。
使用 dma 的优势
成本 将系统与 dma 合并需要 dma 控制器，这可能会使系统更加昂贵。
复杂性 虽然 dma 可以降低中断频率，但它会增加应用程序固件的大小和复杂性。
平台依赖性 dma 控制器在制造商之间和制造商内部具有不同的内部架构，并且根据其本机总线访问方案可能具有不同的行为。
缓存不连贯性 dma 事务可以通过写入内存层次结构的缓存层而导致逻辑错误。这可以通过使用缓存一致的系统体系结构或在 dma 完成后使缓存存储失效来解决。
总线访问和 cpu 周期
虽然dma控制器在节能或加速嵌入式系统方面非常有效，但它们的实现并没有高度标准化。有多种方案可以确保不会与 cpu 同时授予内部总线访问。总线访问方案的目标主要是避免对相同内存位置的并发访问，这可能导致缓存不一致和逻辑错误。单个dma控制器通常配置为采用这些方案之一，因为使用每种方案可能需要不同的硬件或固件控制。大多数 dma 控制器使用的总线访问方案是突发、周期窃取和透明 dma。
透明 dma 一次只能执行一个操作，但它还必须等待处理器执行指令，从而访问所需的数据或地址总线。需要额外的逻辑来验证此访问限制，这种类型的 dma 通常是最慢的。透明 dma 在需要额外处理且不需要访问内存总线的应用中可能是有利的。在这种情况下，优点是消除了对cpu的限制，因为处理器不必完全停止运行。
dma 的类型 优点 缺点
突发 dma 最快的 dma 类型 cpu 空闲时间相对较长
周期窃取 dma cpu 不会长时间闲置 连续时期 比突发 dma 慢
透明 dma 无需限制 cpu 使用量 最慢形式的 dma
图1.dma 操作期间突发 dma 的体系结构图。
突发 dma 通过不频繁的大突发发生，其中 dma 控制器向目标缓冲区发送缓冲区可以容纳的尽可能多的数据。dma 控制器在很短的时间内阻止 cpu 操作以移动大量内存，然后将总线让回主 cpu，重复直到传输完成。突发 dma 通常被认为是最快的类型。
图2.dma 操作期间的周期窃取 dma 发生在两个 cpu 周期之间。
相反，单字节传输或周期窃取 dma 从 cpu 获取提示，并且仅在 cpu 指令之间执行操作。它在两个 cpu 周期之间插入单个操作，因此实际上是在“窃取”cpu 时间。由于一次执行一个操作的限制，它通常比突发 dma 慢。
图3.dma 操作期间的透明 dma 发生在处理器处理不访问数据或地址总线的任务时。
突发 dma 架构示例
图4.max32660上dma控制器的结构图
在max32660上可以找到突发dma控制器的示例（见图4）。上部路径对应于数据流，下部路径表示高级高性能总线 （ahb） 和 dma 逻辑之间的控制/状态流。dma 控制器可以充当 ahb 与内存或外设模块之间的缓冲接口，具体取决于其配置方式。dma 逻辑位于 dma 缓冲区和每个外设之间，用于在事务期间独立管理每个唯一的外设总线。dma 操作一次最多可以移动 32 个字节，前提是源/目标缓冲区可以包含这么多数据。缓冲区最多可容纳 16 mb，并可配置为发送或接收 i2c， spi， i2s和uart以及内部存储器传输。dma 控件的编程可能因协议而异，但外设事务仅由 dma 控制器管理。仲裁器模块控制四个 dma 通道和 cpu 之间的总线访问限制，根据优先级系统授予请求。
现代 dma 选项
总之，dma是现代嵌入式系统的关键功能，这些系统管理大量传感器，需要高吞吐量、高效率和低功耗运行。它的行为类似于专用于内存和外设总线事务的协处理器。
对于许多应用来说，使用 dma 对于最大限度地降低功耗和减轻处理器负载至关重要。例如，健康和可穿戴设备处理大量数据吞吐量，但它们还必须尽可能多地节省电池电量，同时处理敏感数据。adi公司在微控制器上提供快速突发dma架构，这些微控制器非常适合低功耗可穿戴设计，如max32660和max32670。此外，max32666等darwin arm微控制器专为集成蓝牙5的可穿戴和物联网应用而设计。这些器件具有两个 8 通道突发 dma 控制器，集成了对基于事件的事务的支持。它们甚至具有一流的安全硬件，带有安全引导加载程序和信任保护单元 （tpu），用于加速 ecdsa、sha-2 和 aes 加密。从早期的ibm pc到网卡，再到现在的安全、低功耗可穿戴和物联网设备，dma是现代数字系统的基本特征。
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直接内存访问 （dma）
在涉及外设的系统应用中，微处理器在很多方面都可能成为瓶颈。例如，在管理不断发送数据的adc时，处理器可能会经常中断，以至于难以完成其他任务。dma 是一种移动数据并最大限度地减少处理器参与大型或快速数据事务的方法。您可以将 dma 控制器视为一个协处理器，其唯一目的是与内存和外设进行交互。这使得主处理器能够成功地管理贪婪的外设，专注于另一项任务，甚至在后台进行数据交易时进入睡眠状态并节省电力。例如，在 arm 架构上，dma 模块可以在 lp2（睡眠）或 lp3（运行）模式下运行。这在需要延长电池寿命的应用中具有明显的优势，例如可穿戴传感器集线器和智能手表。®
优点和缺点
dma在许多数字系统中都很有用，有时甚至需要它来管理大量的总线流量。它已被用于网卡，图形卡，甚至一些原始的ibm pc。话虽如此，将dma整合到设计中确实有一些权衡。
使用 dma 的优势
中央处理器时间 dma 最大限度地减少了对处理器执行和中断的需求， 减少数据事务所需的 cpu 时间。
功耗 如果 dma 允许处理器在 dma 传输期间休眠，则使用 dma 可以产生最小化功耗的机会。
并行操作 根据系统总线的体系结构细节，处理器可能能够在发生外设事务时执行其他操作。
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成本 将系统与 dma 合并需要 dma 控制器，这可能会使系统更加昂贵。
复杂性 虽然 dma 可以降低中断频率，但它会增加应用程序固件的大小和复杂性。
平台依赖性 dma 控制器在制造商之间和制造商内部具有不同的内部架构，并且根据其本机总线访问方案可能具有不同的行为。
缓存不连贯性 dma 事务可以通过写入内存层次结构的缓存层而导致逻辑错误。这可以通过使用缓存一致的系统体系结构或在 dma 完成后使缓存存储失效来解决。
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虽然dma控制器在节能或加速嵌入式系统方面非常有效，但它们的实现并没有高度标准化。有多种方案可以确保不会与 cpu 同时授予内部总线访问。总线访问方案的目标主要是避免对相同内存位置的并发访问，这可能导致缓存不一致和逻辑错误。单个dma控制器通常配置为采用这些方案之一，因为使用每种方案可能需要不同的硬件或固件控制。大多数 dma 控制器使用的总线访问方案是突发、周期窃取和透明 dma。
透明 dma 一次只能执行一个操作，但它还必须等待处理器执行指令，从而访问所需的数据或地址总线。需要额外的逻辑来验证此访问限制，这种类型的 dma 通常是最慢的。透明 dma 在需要额外处理且不需要访问内存总线的应用中可能是有利的。在这种情况下，优点是消除了对cpu的限制，因为处理器不必完全停止运行。
dma 的类型 优点 缺点
突发 dma 最快的 dma 类型 cpu 空闲时间相对较长
周期窃取 dma cpu 不会长时间闲置 连续时期 比突发 dma 慢
透明 dma 无需限制 cpu 使用量 最慢形式的 dma
图1.dma 操作期间突发 dma 的体系结构图。
突发 dma 通过不频繁的大突发发生，其中 dma 控制器向目标缓冲区发送缓冲区可以容纳的尽可能多的数据。dma 控制器在很短的时间内阻止 cpu 操作以移动大量内存，然后将总线让回主 cpu，重复直到传输完成。突发 dma 通常被认为是最快的类型。
图2.dma 操作期间的周期窃取 dma 发生在两个 cpu 周期之间。
相反，单字节传输或周期窃取 dma 从 cpu 获取提示，并且仅在 cpu 指令之间执行操作。它在两个 cpu 周期之间插入单个操作，因此实际上是在“窃取”cpu 时间。由于一次执行一个操作的限制，它通常比突发 dma 慢。
图3.dma 操作期间的透明 dma 发生在处理器处理不访问数据或地址总线的任务时。
突发 dma 架构示例
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在max32660上可以找到突发dma控制器的示例（见图4）。上部路径对应于数据流，下部路径表示高级高性能总线 （ahb） 和 dma 逻辑之间的控制/状态流。dma 控制器可以充当 ahb 与内存或外设模块之间的缓冲接口，具体取决于其配置方式。dma 逻辑位于 dma 缓冲区和每个外设之间，用于在事务期间独立管理每个唯一的外设总线。dma 操作一次最多可以移动 32 个字节，前提是源/目标缓冲区可以包含这么多数据。缓冲区最多可容纳 16 mb，并可配置为发送或接收 i2c， spi， i2s和uart以及内部存储器传输。dma 控件的编程可能因协议而异，但外设事务仅由 dma 控制器管理。仲裁器模块控制四个 dma 通道和 cpu 之间的总线访问限制，根据优先级系统授予请求。
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