AXI4-Lite总线信号
在《axi-lite 自定义ip》章节基础上，添加ilavio等调试ip，完成后的bd如下图：
图4‑53 添加测试信号
加载到sdk，并且在vivado中连接到开发板。
trigger setup，点击“+”，选择 axi_wvalid，双击添加。设置 radix 为 b，触发条件 value 为 1。
图4‑54 添加信号
设置触发位置为 512
图4‑55 设置触发位置
单击运行按钮，启动触发，进入等待触发状态。
图4‑56 等待触发
单击 sdk 中的运行按钮后， vivado 中 hw_ila2 窗口采集到波形输出，可以看到 axi 总线的工作时序。
sdk中 mian.c 程序功能是向 axi4 总线写入 1~4，再从 axi4 总线读数据，从上面对未修改直接封装的 ip 分析，可以读出的数据应等于写入的数据。
从波形图可以看出，写入的数据是 1、 2、 3、 4，对应基地址的偏移地址是 0、 4、 8、 12。
图4‑57 仿真结果
原文标题：观察 axi4-lite 总线信号
文章出处：【微信公众号：openfpga】欢迎添加关注！文章转载请注明出处。
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sdk中 mian.c 程序功能是向 axi4 总线写入 1~4，再从 axi4 总线读数据，从上面对未修改直接封装的 ip 分析，可以读出的数据应等于写入的数据。
从波形图可以看出，写入的数据是 1、 2、 3、 4，对应基地址的偏移地址是 0、 4、 8、 12。
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