AT89S52单片机的引脚说明
at89s52单片机性能说明：
at89s52是一种低功耗、高性能cmos 8位微控制器，具有8k在系统可编程flash存储器。它是使用atmel公司高密度非易失性存储器技术制造，并与业界标准80c51产品指令和引脚完全兼容。片上flash允许程序存储器在系统可编程，也就是适合于常规编程器。在单芯片上，拥有灵巧的8位cpu和在系统可编程flash，使得at89s52为众多嵌入式控制应用系统提供高灵活及非常有效的解决方案。at89s52单片机提供一下标准功能：8k字节flash，256字节ram，32位i/o口线，看门狗定时器，2个数据指针，三个16位定时器/计数器，一个6向量2级中断结构，全双工串行口，片内晶振及时钟电路。此外，at89s52单片机的设计与操作频率可下降到0 hz静态逻辑，支持2种软件可选的节电模式。在空闲模式下，cpu停止工作，而ram，定时器/计数器，串行口，外中断系统可继续工作。在掉电保护模式下，ram内容可以被保存，但振荡器将被冻结，单片机一切工作停止，直到下一个中断或者硬件复位为止。其引脚配置如图所示：（三种封装：pdip、plcc、tqfp）
引脚说明：
p0 口：p0口是一个8位漏极开路的双向i/o口。作为输出口，每位能驱动8个ttl逻 辑电平。对p0端口写“1”时，引脚用作高阻抗输入。当访问外部程序和数据存储器时，p0口也被作为低8位地址/数据复用。在这种模式下，p0具有内部上拉电阻。在flash编程时，p0口也用来接收指令字节;在程序校验时，输出指令字节。程序校验时，需要外部上拉电阻。
p1 口：p1 口是一个具有内部上拉电阻的8 位双向i/o 口，p1 输出缓冲器能驱动4 个 ttl 逻辑电平。对p1 端口写“1”时，内部上拉电阻把端口拉高，此时可以作为输入口使用。作为输入使用时，被外部拉低的引脚由于内部电阻的原因，将输出电流（iil）。此外，p1.0和p1.2分别作定时器/计数器2的外部计数输入（p1.0/t2）和时器/计数器2 的触发输入（p1.1/t2ex），具体如下表所示。在flash编程和校验时，p1口接收低8位地址字节。
引脚号第二功能：
管脚号引脚第二功能
p1.0t2（定时器/计数器t2的外部计数输入），时钟输出
p1.1t2ex（定时器/计数器t2的捕捉/重载触发信号和方向控制）
p1.5mosi（用于系统编程）
p1.6miso（用于系统编程）
p1.7sck（用于系统编程）
p2 口：p2 口是一个具有内部上拉电阻的8 位双向i/o 口，p2 输出缓冲器能驱动4 个ttl 逻辑电平。对p2 端口写“1”时，内部上拉电阻把端口拉高，此时可以作为输入口使用。作为输入使用时，被外部拉低的引脚由于内部电阻的原因，将输出电流（iil）。在访问外部程序存储器或用16位地址读取外部数据存储器（例如执行movx @dptr）时，p2 口送出高八位地址。在这种应用中，p2 口使用很强的内部上拉发送1。在使用 8位地址（如movx @ri）访问外部数据存储器时，p2口输出p2锁存器的内容。 在flash编程和校验时，p2口也接收高8位地址字节和一些控制信号。
p3 口：p3 口是一个具有内部上拉电阻的8 位双向i/o 口，p3 输出缓冲器能驱动4 个ttl 逻辑电平。对p3 端口写“1”时，内部上拉电阻把端口拉高，此时可以作为输入口使用。作为输入使用时，被外部拉低的引脚由于内部电阻的原因，将输出电流（iil）。p3口亦作为at89s52特殊功能（第二功能）使用，在flash编程和校验时，p3口也接收一些控制信号。
引脚号第二功能：
管脚号引脚第二功能
p3.0rxd（串行输入口）
p3.1txd（串行输出口）
p3.2int0（外部中断0）
p3.3int1（外部中断1）
p3.4t0（定时/计数器0）
p3.5t1（定时/计数器1）
p3.6wr（外部数据存储器写选通）
p3.7rd（外部数据存储器读选通）
此外，p3口还接收一些用于flash闪存编程和程序校验的控制信号。
rst——复位输入。当振荡器工作时，rst引脚出现两个机器周期以上高电平将是单片机复位。
ale/prog——当访问外部程序存储器或数据存储器时，ale（地址锁存允许）输出脉冲用于锁存地址的低8位字节。一般情况下， ale仍以时钟振荡频率的1/6输出固定的脉冲信号，因此它可对外输出时钟或用于定时目的。要注意的是：每当访问外部数据存储器时将跳过一个ale脉冲。对flash存储器编程期间，该引脚还用于输入编程脉冲（prog）。如有必要，可通过对特殊功能寄存器（sfr）区中的8eh单元的d0位置位，可禁止ale操作。该位置位后，只有一条movx和movc指令才能将ale激活。此外，该引脚会被微弱拉高，单片机执行外部程序时，应设置ale禁止位无效。
psen——程序储存允许（psen）输出是外部程序存储器的读选通信号，当at89c52由外部程序存储器取指令（或数据）时，每个机器周期两次psen有效，即输出两个脉冲，在此期间，当访问外部数据存储器，将跳过两次psen信号。
ea/vpp——外部访问允许，欲使cpu仅访问外部程序存储器（地址为0000h-ffffh），ea端必须保持低电平（接地）。需注意的是：如果加密位lb1被编程，复位时内部会锁存ea端状态。 如ea端为高电平（接vcc端），cpu则执行内部程序存储器的指令。flash存储器编程时，该引脚加上+12v的编程允许电源vpp，当然这必须是该器件是使用12v编程电压vpp。
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p0 口：p0口是一个8位漏极开路的双向i/o口。作为输出口，每位能驱动8个ttl逻 辑电平。对p0端口写“1”时，引脚用作高阻抗输入。当访问外部程序和数据存储器时，p0口也被作为低8位地址/数据复用。在这种模式下，p0具有内部上拉电阻。在flash编程时，p0口也用来接收指令字节;在程序校验时，输出指令字节。程序校验时，需要外部上拉电阻。
p1 口：p1 口是一个具有内部上拉电阻的8 位双向i/o 口，p1 输出缓冲器能驱动4 个 ttl 逻辑电平。对p1 端口写“1”时，内部上拉电阻把端口拉高，此时可以作为输入口使用。作为输入使用时，被外部拉低的引脚由于内部电阻的原因，将输出电流（iil）。此外，p1.0和p1.2分别作定时器/计数器2的外部计数输入（p1.0/t2）和时器/计数器2 的触发输入（p1.1/t2ex），具体如下表所示。在flash编程和校验时，p1口接收低8位地址字节。
引脚号第二功能：
管脚号引脚第二功能
p1.0t2（定时器/计数器t2的外部计数输入），时钟输出
p1.1t2ex（定时器/计数器t2的捕捉/重载触发信号和方向控制）
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p1.7sck（用于系统编程）
p2 口：p2 口是一个具有内部上拉电阻的8 位双向i/o 口，p2 输出缓冲器能驱动4 个ttl 逻辑电平。对p2 端口写“1”时，内部上拉电阻把端口拉高，此时可以作为输入口使用。作为输入使用时，被外部拉低的引脚由于内部电阻的原因，将输出电流（iil）。在访问外部程序存储器或用16位地址读取外部数据存储器（例如执行movx @dptr）时，p2 口送出高八位地址。在这种应用中，p2 口使用很强的内部上拉发送1。在使用 8位地址（如movx @ri）访问外部数据存储器时，p2口输出p2锁存器的内容。 在flash编程和校验时，p2口也接收高8位地址字节和一些控制信号。
p3 口：p3 口是一个具有内部上拉电阻的8 位双向i/o 口，p3 输出缓冲器能驱动4 个ttl 逻辑电平。对p3 端口写“1”时，内部上拉电阻把端口拉高，此时可以作为输入口使用。作为输入使用时，被外部拉低的引脚由于内部电阻的原因，将输出电流（iil）。p3口亦作为at89s52特殊功能（第二功能）使用，在flash编程和校验时，p3口也接收一些控制信号。
引脚号第二功能：
管脚号引脚第二功能
p3.0rxd（串行输入口）
p3.1txd（串行输出口）
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p3.3int1（外部中断1）
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