PHY芯片上电时序要求和问题分析
1. 背景简述
本文将分析一个实际phy应用项目中存在的时序问题：该时序问题导致上电后，3.3v、3.3v-aqc、2.1v-aqc、1.2v-aqc和0.8v-aqc这几个电源本来应该是直流，却变成了类似于方波的周期信号。分析出root cause并给出了解决方法。
2. phy芯片上电时序要求
图1：phy芯片供电框图
图1所示，该phy芯片对四个电源的上电时序要求，从低电压到高电压依次是： 0.8v-aqc => 1.2v-aqc => 2.1v-aqc => 3.3v-aqc 。
所以，基于上述时序要求，我们设计的电源为buck u1 isl91127ir 输出3.3v作为母线电压；这里先说明，该芯片的过流保护阈值ocp = 4.5a。使用u2 mp2154芯片从3.3v转换出0.8v-aqc电源；使用u2(0.8v-aqc的电源良好pg(power good)信号来使能u3 mp1601芯片，从3.3v转换出1.2v-aqc；使用u3(1.2v-aqc)的pg信号来使能u4 mp1601，从3.3v转换出2.1v-aqc；使用u4(2.1v-aqc)的pg信号来使能由分立元件组成的loadswitch开关，从3.3v转换为3.3v-aqc。
注：mp2145是带pg信号的，实际电路中是需要上拉的；mp1601是不带pg信号的，图中u3/u4标示的pg仅做理解，实际上u3/u4的pg信号分别是电源输出1.2v-aqc/2.1v-aqc。
图2：分立元件组成的loadswitch
图2所示，是我们在图1中使用的的由分立元件组成的loadswitch，其中的阻容参数也是初次电路中使用的。
3. 主板初次上电，发现有缺陷bug（电压波形）
图3：黄色3.3v，蓝色1.2v-aqc，绿色0.8v-aqc（图中只抓取了2个周期）
图4：“周期信号”细节
主板上电后，发现phy芯片的几个直流电源，变成了“周期信号”，周期约为30ms。
4. 调试过程debug
图5：黄色3.3v、蓝色3.3v-aqc、绿色2.1v-aqc
图6：黄色3.3v、 蓝色3.3v-aqc、绿色2.1v-aqc （细节放大）
通过图6可以发现，在2.1v-aqc从0上升到目标电压2.1v的过程中，3.3v-aqc就已经从0快速上升到了目标电压3.3v，也就是说3.3v-aqc在2.1v-aqc之前完成了上电。
通过以上图3-6可以发现，这里实际的上电时序是3.3v => 0.8v-aqc => 1.2v-aqc => 3.3v-aqc => 2.1v-aqc，这与该phy芯片要求的上电时序严格从小到大依次是 0.8v-aqc => 1.2v-aqc => 2.1v-aqc => 3.3v-aqc是不相符的。
5. 测量3.3v电源的电流波形
图7：3.3v电源的电流反复周期约为30ms
图8：由于电流探头未设置好，图中的电流值乘以10倍即是真实测得值。
通过图7-8可见，用电流钳测得3.3v电源（所用芯片为isl91127ir，限流4.5a）的电流波形，超过4.5a时芯片关断输出，电流迅速下降；峰值电流的周期约30ms，与电压反复的周期30ms基本相同。
root cause根因总结：
这是由于实际的电源时序设计未能满足数字芯片的上电时序导致了芯片发生latch-up，进而有大电流，导致前级3.3v母线电压因超过其ocp阈值4.5a而关断；然后u1 isl91127ir间隔30ms左右重新开启，继续下一个循环，如此打嗝...
6. 缺陷修复方法
解决方法：将3.3v-aqc从0上升到目标值的时间推移到2.1v-aqc的目标值2.1v之后即可。
图9：在图2基础上增加r4=100k和c2=100nf
图9所示，在图2基础上增加r4=100k和c2=100nf；c2相当于增加q2的源极s和栅极g之间的寄生电容，r4是减小了当q1导通之后q2的源极-栅极之间电容的充电速率，从而延长了q2的导通速率，从而将3.3v-aqc推移到2.1v-aqc之后。
7. 修复结果验证
图10：3.3v-aqc目标值落在2.1v-aqc目标值之后约7ms
综上所述，本文通过不良现象，分析出了因电源时序不满足要求而导致的数字芯片latch-up，从而导致过流问题，电源芯片处于打嗝模式...进而通过增加rc延迟修复该电路的时序问题，达到解决问题的目的。
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2. phy芯片上电时序要求
图1：phy芯片供电框图
图1所示，该phy芯片对四个电源的上电时序要求，从低电压到高电压依次是： 0.8v-aqc => 1.2v-aqc => 2.1v-aqc => 3.3v-aqc 。
所以，基于上述时序要求，我们设计的电源为buck u1 isl91127ir 输出3.3v作为母线电压；这里先说明，该芯片的过流保护阈值ocp = 4.5a。使用u2 mp2154芯片从3.3v转换出0.8v-aqc电源；使用u2(0.8v-aqc的电源良好pg(power good)信号来使能u3 mp1601芯片，从3.3v转换出1.2v-aqc；使用u3(1.2v-aqc)的pg信号来使能u4 mp1601，从3.3v转换出2.1v-aqc；使用u4(2.1v-aqc)的pg信号来使能由分立元件组成的loadswitch开关，从3.3v转换为3.3v-aqc。
注：mp2145是带pg信号的，实际电路中是需要上拉的；mp1601是不带pg信号的，图中u3/u4标示的pg仅做理解，实际上u3/u4的pg信号分别是电源输出1.2v-aqc/2.1v-aqc。
图2：分立元件组成的loadswitch
图2所示，是我们在图1中使用的的由分立元件组成的loadswitch，其中的阻容参数也是初次电路中使用的。
3. 主板初次上电，发现有缺陷bug（电压波形）
图3：黄色3.3v，蓝色1.2v-aqc，绿色0.8v-aqc（图中只抓取了2个周期）
图4：“周期信号”细节
主板上电后，发现phy芯片的几个直流电源，变成了“周期信号”，周期约为30ms。
4. 调试过程debug
图5：黄色3.3v、蓝色3.3v-aqc、绿色2.1v-aqc
图6：黄色3.3v、 蓝色3.3v-aqc、绿色2.1v-aqc （细节放大）
通过图6可以发现，在2.1v-aqc从0上升到目标电压2.1v的过程中，3.3v-aqc就已经从0快速上升到了目标电压3.3v，也就是说3.3v-aqc在2.1v-aqc之前完成了上电。
通过以上图3-6可以发现，这里实际的上电时序是3.3v => 0.8v-aqc => 1.2v-aqc => 3.3v-aqc => 2.1v-aqc，这与该phy芯片要求的上电时序严格从小到大依次是 0.8v-aqc => 1.2v-aqc => 2.1v-aqc => 3.3v-aqc是不相符的。
5. 测量3.3v电源的电流波形
图7：3.3v电源的电流反复周期约为30ms
图8：由于电流探头未设置好，图中的电流值乘以10倍即是真实测得值。
通过图7-8可见，用电流钳测得3.3v电源（所用芯片为isl91127ir，限流4.5a）的电流波形，超过4.5a时芯片关断输出，电流迅速下降；峰值电流的周期约30ms，与电压反复的周期30ms基本相同。
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6. 缺陷修复方法
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图9所示，在图2基础上增加r4=100k和c2=100nf；c2相当于增加q2的源极s和栅极g之间的寄生电容，r4是减小了当q1导通之后q2的源极-栅极之间电容的充电速率，从而延长了q2的导通速率，从而将3.3v-aqc推移到2.1v-aqc之后。
7. 修复结果验证
图10：3.3v-aqc目标值落在2.1v-aqc目标值之后约7ms
综上所述，本文通过不良现象，分析出了因电源时序不满足要求而导致的数字芯片latch-up，从而导致过流问题，电源芯片处于打嗝模式...进而通过增加rc延迟修复该电路的时序问题，达到解决问题的目的。
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