采用DSP芯片DM642实现桥梁缆索表面缺陷检测系统的设计
作为斜拉桥主要受力构件的桥梁缆索，由于其长期暴露在大气之中，表面会受到严重的破坏。目前国内的人工检测方法费时费力、安全隐患大，因此，迫切需要研制一种智能型桥梁缆索表面缺陷检测系统。随着桥梁缆索市场竞争的愈发激烈，快速有效的掌握市场发展情况成为企业及决策者成功的关键。市场分析是一个科学系统的工作，直接影响着企业发展战略的规划、产品营销方案的设计、公司投资方针的制定以及未来发展方向的确定。市场分析并非单纯从某一个层面对市场进行评价，要得到有实际价值、具有指导意义的结论，就必须从专业的角度对市场进行全面细致的分析。
1 系统总体硬件设计及工作原理
德州仪器公司（ti）推出的tms320dm642（简称dm642）是专门用于数字媒体应用的tms320c6000家族中性能最高的定点dsp，具有极强的单核处理能力以及高度的灵活性和可编程性。该芯片除了极强的处理能力外，还具有两级高速缓存l1 cache和l2 cache；64 bit的edma控制器，负责片内l2cache与其他外设之间的数据传输； 64 bit emif（外部存储器接口）可以方便地与sdram、flash和uart实现无缝连接；3个视频专用端口（vp0、vp1、vp2），可分别配置为2路，最多可实现6路视频采集；支持pci、hpi、iic和emac，通信便利。
基于dm642的桥梁缆索表面缺陷检测系统主要由以下几大模块组成：图像采集模块、数据及程序存储模块、图像处理模块、图像传输模块、系统控制模块以及接收模块等。其主要硬件组成为：3路ccd摄像头、3个图像采集的a/d转换芯片saa7113、高速图像采集及处理的dsp芯片dm642、图像数据存储器sdram、程序存储器flash、系统控制模块cpld芯片epm3128a、网络化传输芯片lxt971a、地面接收机（pc）以及其他功能模块等。其硬件框图如图1所示。
系统工作原理为：3路模拟视频经图像传感器（ccd）输入，经过3路a/d转换芯片saa7113转换为数字信号，经过核心芯片dm642的视频输入口（vp0、vp2）进入dm642的fifo（先入先出缓存器），再传输到dm642片外的同步动态存储器中；通过dm642的压缩编码经以太网口（emac）以及物理层收发芯片lxt971a传输到地面服务器（pc）。ccd是于1969年由美国贝尔实验室（bell labs）的维拉·波义耳（willard s. boyle）和乔治·史密斯（george e. smith）所发明的。当时贝尔实验室正在发展影像电话和半导体气泡式内存。将这两种新技术结合起来后，波义耳和史密斯得出一种装置，他们命名为“电荷‘气泡’元件”（charge “bubble” devices）。这种装置的特性就是它能沿着一片半导体的表面传递电荷，便尝试用来做为记忆装置，当时只能从暂存器用“注入”电荷的方式输入记忆。但随即发现光电效应能使此种元件表面产生电荷，而组成数位影像。 到了70年代，贝尔实验室的研究员已经能用简单的线性装置捕捉影像，ccd就此诞生。有几家公司接续此一发明，着手进行进一步的研究，包括快捷半导体（fairchild semiconductor）、美国无线电公司（rca）和德州仪器（texas instruments）。其中快捷半导体的产品率先上市，于1974年发表500单元的线性装置和100x100像素的平面装置。
本系统选用altera公司max3000s系列中的cpld芯片epm3128a进行控制。cpld与dm642、saa7113、lxt971a、sdram、flash之间均使用通用可编程的i/o口相连，进行图像采集控制、图像数据的重抽样、地址译码、图像传输控制等。
1.1 图像采集模块
由于缆索表面近似为圆柱形，系统中沿缆索机器人均匀布置3个ccd（每个ccd之间的夹角为120°）采集同一时刻缆索表面一周的图像。而dm642配置有3个专用的视频端口，每个端口可分别配置为2个通道，最多可实现6路视频的采集。
为了同时支持3路视频信号的采集，本系统中dm642的视频口0（vp0）分成a、b 2个通道，分别作为2个8 bit的视频输入接口；视频口2（vp2）选用a通道作为8 bit的视频输入口，这样便实现了3路视频信号的采集。
系统的图像采集模块主要由：3路视频输入、3路视频a/d转换芯片saa7113、视频端口的fifo、i2c总线、同步动态存储器组成。
经摄像头（ccd）输出3路复合视频信号（cvbs），采用saa7113专用视频解码芯片完成视频信号解码和转换功能［3，4］。在数字化过程中，由dm642的i2c总线进行控制，其输出格式可由i2c初始化其寄存器来设置。由于dm642的视频输入口只能接收标准的bt656-yuv4:2：2（8 bit）信号，故在i2c初始化时设置saa7113的数字化输出格式为bt656的格式，可通过写iic的寄存器来实现。
由于dm642的视频口vp0分成2个8 bit的通道a、b，所以saa7113和dm642的连接方式只能采用最简连线的bt656的方式，即不需要水平、垂直、场同步信号线。图2所示为vp0端口的一路视频输入电路图，其他2路与该路基本相同。
其中：输入视频经过j5接口的信号线3、上拉电阻（18 ω）以及电容（47 nf），与saa7113的模拟输入端ai22直接相连；vp0［0-7］为saa7113的数据输出管脚，与dm642视频口0中的vp0d［2-9］管脚相连；时钟同步信号llc与dm642视频口0的vp0clk0相连；scl和sda作为i2c接口的时钟线和数据线，分别与dm642的i2c总线接口的时钟和数据线scl0、sda0相连；trst作为复位信号与dm642的复位信号reset相连；xtal与xtal1的管脚间接24.576 mhz的晶振，在vdda1管脚上提供+3.3 v的电压供电，供芯片正常工作。
1.2 图像存储模块
（1）sdram
sdram:synchronous dynamic random access memory，同步动态随机存储器，同步是指 memory工作需要同步时钟，内部的命令的发送与数据的传输都以它为基准；动态是指存储阵列需要不断的刷新来保证数据不丢失；随机是指数据不是线性依次存储，而是自由指定地址进行数据读写。所谓的影响性能是并不是指sdram的带宽，频率与位宽固定后，带宽也就不可更改了。但这是理想的情况，在内存的工作周期内，不可能总处于数据传输的状态，因为要有命令、寻址等必要的过程。但这些操作占用的时间越短，内存工作的效率越高，性能也就越好。非数据传输时间的主要组成部分就是各种延迟与潜伏期。通过上文的讲述，大家应该很明显看出有三个参数对内存的性能影响至关重要，它们是trcd、cl和trp。每条正规的内存模组都会在标识上注明这三个参数值，可见它们对性能的敏感性。
dm642芯片内部只集成了256 kb的ram，因此需要在外部存储器接口（emif）上扩展存储空间。dm642的emif为64 bit的数据总线接口，工作的最高频率为133 mhz，分为4个存储空间（ce0-ce3），每个有256 mb的寻址空间。它在ce0空间提供了64 bit的sdram接口总线（无缝连接），分配给外扩的sdram使用。
sdram在ce0空间的具体定位为：0x80000000-0x81ffffff。输入模拟视频经数字化后进入视频端口的bt656（y:u：v 4：2：2）数据流，以便于图像的压缩编码。在cpld控制下实现图像数据的重抽样，之后通过edma的方式存储到sdram中。
（2）flash
本系统采用4 m×8 bit的am29lv320d映射到ce1的低地址空间，用来存储程序，实现系统的自启动。它在ce1空间的具体定位为：0x90000000-0x9007ffff。dm642的ce1空间被配置成8 bit，以适应自启动要求。4 mb的存储空间需要22根地址线来寻址，而dm642的emif口可用地址线只有20条。其中flash的最高2根地址线由dm642的gpio中的gpio1、gpio2来模拟地址线，从而实现flash的页选。
1.3 图像传输模块
在所设计的系统中，3路ccd采集的缆索1周的图像，经数字化后同时送入dm642的视频端口，并且随着缆索爬升装置的爬升，不断重复采集。采集的图像数据量很大，持续时间较长。如果dm642通过图像处理算法，实时检测图像的缺陷，便要运行大量的算法程序，这就给dm642造成了很大的负担，因此本系统dm642只是对采集的图像数据进行压缩编码，并实时传输到地面的服务器（pc），具体图像识别算法在pc机上进行，这就大大减轻了dm642的负担，提高了dm642实时采集、传输的效率。
鉴于高速、大量图像数据的采集，系统采用dm642的网络接口实现传输。该系统中图像分辨率为720×576，帧频为25帧/s，采用h.263压缩编码算法，压缩比可达100：1，即数据流可压缩为：3×720×576×8×25÷100=2 488 340 b/s，约为2 500 kb/s。考虑到以太网传输，数据传输包头、包尾等附加数据，系统最大数据流为3 000 kb/s=3 mb/s，而选用的网络接口芯片的传输速度为10 mb/s，故可以实现图像数据的实时处理与传输。
emac提供了数据链路层的功能［7］，所以只需要利用一块物理层的网络芯片——以太网phy收发器lxt971alc转换信号，经网络变压器与internet相连，从而把采集到的图像数据发送到地面服务器（pc），硬件连接电路图如图3。其中：dm642的各信号线与phy网络收发器芯片lxt971alc的对应信号线直接连接，输出数据经网络变压器13f-60ldnl以及rj45接口连接到internet上，从而发送到pc机。图3中dm642的各信号线说明如表1。
2 系统软件设计
2.1 系统主程序设计
本系统的软件是在ti公司提供的集成开发环境ccs下开发的。通过xds510 usb2.0仿真器，将在pc上ccs环境下编写、调试完成的程序烧入dm642的flash中，便可以在dm642上电后自动运行执行程序，实现图像的采集、处理与传输，达到缺陷检测的目的。
本系统的主程序完成各种寄存器的初始化工作、实时采集并存储摄像机传送来的视频图像，经过dm642的压缩编码，通过网口发送采集的图像数据，通知cpld继续下一次采集直至检测结束。软件设计流程如图4所示。
具体工作过程为：上电后系统程序自动从flash装载到dsp的片内ram中，装载完毕，dm642自动调用程序ram中的代码执行。首先通过i2c总线对a/d芯片saa7113的工作参数进行设置，在图像采集控制电路（由cpld实现）的作用下，saa7113按设定的工作参数获取图像（本系统设定的数据输出流为bt656格式即：y:u：v 4:2：2），地址译码电路（由cpld实现）将数字图像数据重新抽样后存储在片外数据存储器sdram中，经dm642实时压缩处理后，通过网络芯片接口，tcp/ip协议传输到地面的服务器（pc机）。
2.2 图像压缩算法设计
视频图像只有通过压缩后才能正确地通过网络传输。本系统的图像压缩采用h.263数字图像压缩算法，由信号处理器dm642来完成。h.263压缩以帧内变换与帧间预测相结合的混合编码技术为核心，适合视频流的实时网络化传输，比h.264算法成熟、稳定，且实现简单。
由于h.263压缩标准只需要cif格式（y:u：v 4∶2∶0）的视频图像，故需将数字化的720×576 4∶2∶2的图像抽样为352×288 4∶2∶0的视频图像，再写入sdram中。重新抽样完成后，再由dm642读取sdram中的数据进行压缩编码，输出的视频码流经网口传输到pc上。
本系统h.263压缩编码设计流程有：编码参数设置，视频数据输入，帧内编码，帧间编码，熵编码和码流输出。编码流程图如图5所示。
3 系统测试及试验结果
将检测装置装在缆索机器人上，用交叉网线连接dm642以太网口与地面服务器（pc机），硬件连接完毕后，准备测试。系统上电，随着缆索机器人的爬升，3路ccd进行图像采集，经dm642的压缩处理后通过internet传输到pc机上。pc机接收到图像信号后，进行图像解码，并在屏幕上显示，完成一次图像的压缩与解压缩过程。继续采集下一次，直至完成检测。
经试验证明，本文介绍的基于dm642的缆索缺陷图像采集及传输系统可以很好地完成缆索表面图像的采集和网络化传输功能，并在pc机上显示，以供图像处理，达到了预期的目标。该系统具有一定的通用性和扩展性，可用作串口、hpi接口、无线传输等多种传输方式的扩展，同时也可用作其他目标对象的缺陷检。
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基于dm642的桥梁缆索表面缺陷检测系统主要由以下几大模块组成：图像采集模块、数据及程序存储模块、图像处理模块、图像传输模块、系统控制模块以及接收模块等。其主要硬件组成为：3路ccd摄像头、3个图像采集的a/d转换芯片saa7113、高速图像采集及处理的dsp芯片dm642、图像数据存储器sdram、程序存储器flash、系统控制模块cpld芯片epm3128a、网络化传输芯片lxt971a、地面接收机（pc）以及其他功能模块等。其硬件框图如图1所示。
系统工作原理为：3路模拟视频经图像传感器（ccd）输入，经过3路a/d转换芯片saa7113转换为数字信号，经过核心芯片dm642的视频输入口（vp0、vp2）进入dm642的fifo（先入先出缓存器），再传输到dm642片外的同步动态存储器中；通过dm642的压缩编码经以太网口（emac）以及物理层收发芯片lxt971a传输到地面服务器（pc）。ccd是于1969年由美国贝尔实验室（bell labs）的维拉·波义耳（willard s. boyle）和乔治·史密斯（george e. smith）所发明的。当时贝尔实验室正在发展影像电话和半导体气泡式内存。将这两种新技术结合起来后，波义耳和史密斯得出一种装置，他们命名为“电荷‘气泡’元件”（charge “bubble” devices）。这种装置的特性就是它能沿着一片半导体的表面传递电荷，便尝试用来做为记忆装置，当时只能从暂存器用“注入”电荷的方式输入记忆。但随即发现光电效应能使此种元件表面产生电荷，而组成数位影像。 到了70年代，贝尔实验室的研究员已经能用简单的线性装置捕捉影像，ccd就此诞生。有几家公司接续此一发明，着手进行进一步的研究，包括快捷半导体（fairchild semiconductor）、美国无线电公司（rca）和德州仪器（texas instruments）。其中快捷半导体的产品率先上市，于1974年发表500单元的线性装置和100x100像素的平面装置。
本系统选用altera公司max3000s系列中的cpld芯片epm3128a进行控制。cpld与dm642、saa7113、lxt971a、sdram、flash之间均使用通用可编程的i/o口相连，进行图像采集控制、图像数据的重抽样、地址译码、图像传输控制等。
1.1 图像采集模块
由于缆索表面近似为圆柱形，系统中沿缆索机器人均匀布置3个ccd（每个ccd之间的夹角为120°）采集同一时刻缆索表面一周的图像。而dm642配置有3个专用的视频端口，每个端口可分别配置为2个通道，最多可实现6路视频的采集。
为了同时支持3路视频信号的采集，本系统中dm642的视频口0（vp0）分成a、b 2个通道，分别作为2个8 bit的视频输入接口；视频口2（vp2）选用a通道作为8 bit的视频输入口，这样便实现了3路视频信号的采集。
系统的图像采集模块主要由：3路视频输入、3路视频a/d转换芯片saa7113、视频端口的fifo、i2c总线、同步动态存储器组成。
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由于dm642的视频口vp0分成2个8 bit的通道a、b，所以saa7113和dm642的连接方式只能采用最简连线的bt656的方式，即不需要水平、垂直、场同步信号线。图2所示为vp0端口的一路视频输入电路图，其他2路与该路基本相同。
其中：输入视频经过j5接口的信号线3、上拉电阻（18 ω）以及电容（47 nf），与saa7113的模拟输入端ai22直接相连；vp0［0-7］为saa7113的数据输出管脚，与dm642视频口0中的vp0d［2-9］管脚相连；时钟同步信号llc与dm642视频口0的vp0clk0相连；scl和sda作为i2c接口的时钟线和数据线，分别与dm642的i2c总线接口的时钟和数据线scl0、sda0相连；trst作为复位信号与dm642的复位信号reset相连；xtal与xtal1的管脚间接24.576 mhz的晶振，在vdda1管脚上提供+3.3 v的电压供电，供芯片正常工作。
1.2 图像存储模块
（1）sdram
sdram:synchronous dynamic random access memory，同步动态随机存储器，同步是指 memory工作需要同步时钟，内部的命令的发送与数据的传输都以它为基准；动态是指存储阵列需要不断的刷新来保证数据不丢失；随机是指数据不是线性依次存储，而是自由指定地址进行数据读写。所谓的影响性能是并不是指sdram的带宽，频率与位宽固定后，带宽也就不可更改了。但这是理想的情况，在内存的工作周期内，不可能总处于数据传输的状态，因为要有命令、寻址等必要的过程。但这些操作占用的时间越短，内存工作的效率越高，性能也就越好。非数据传输时间的主要组成部分就是各种延迟与潜伏期。通过上文的讲述，大家应该很明显看出有三个参数对内存的性能影响至关重要，它们是trcd、cl和trp。每条正规的内存模组都会在标识上注明这三个参数值，可见它们对性能的敏感性。
dm642芯片内部只集成了256 kb的ram，因此需要在外部存储器接口（emif）上扩展存储空间。dm642的emif为64 bit的数据总线接口，工作的最高频率为133 mhz，分为4个存储空间（ce0-ce3），每个有256 mb的寻址空间。它在ce0空间提供了64 bit的sdram接口总线（无缝连接），分配给外扩的sdram使用。
sdram在ce0空间的具体定位为：0x80000000-0x81ffffff。输入模拟视频经数字化后进入视频端口的bt656（y:u：v 4：2：2）数据流，以便于图像的压缩编码。在cpld控制下实现图像数据的重抽样，之后通过edma的方式存储到sdram中。
（2）flash
本系统采用4 m×8 bit的am29lv320d映射到ce1的低地址空间，用来存储程序，实现系统的自启动。它在ce1空间的具体定位为：0x90000000-0x9007ffff。dm642的ce1空间被配置成8 bit，以适应自启动要求。4 mb的存储空间需要22根地址线来寻址，而dm642的emif口可用地址线只有20条。其中flash的最高2根地址线由dm642的gpio中的gpio1、gpio2来模拟地址线，从而实现flash的页选。
1.3 图像传输模块
在所设计的系统中，3路ccd采集的缆索1周的图像，经数字化后同时送入dm642的视频端口，并且随着缆索爬升装置的爬升，不断重复采集。采集的图像数据量很大，持续时间较长。如果dm642通过图像处理算法，实时检测图像的缺陷，便要运行大量的算法程序，这就给dm642造成了很大的负担，因此本系统dm642只是对采集的图像数据进行压缩编码，并实时传输到地面的服务器（pc），具体图像识别算法在pc机上进行，这就大大减轻了dm642的负担，提高了dm642实时采集、传输的效率。
鉴于高速、大量图像数据的采集，系统采用dm642的网络接口实现传输。该系统中图像分辨率为720×576，帧频为25帧/s，采用h.263压缩编码算法，压缩比可达100：1，即数据流可压缩为：3×720×576×8×25÷100=2 488 340 b/s，约为2 500 kb/s。考虑到以太网传输，数据传输包头、包尾等附加数据，系统最大数据流为3 000 kb/s=3 mb/s，而选用的网络接口芯片的传输速度为10 mb/s，故可以实现图像数据的实时处理与传输。
emac提供了数据链路层的功能［7］，所以只需要利用一块物理层的网络芯片——以太网phy收发器lxt971alc转换信号，经网络变压器与internet相连，从而把采集到的图像数据发送到地面服务器（pc），硬件连接电路图如图3。其中：dm642的各信号线与phy网络收发器芯片lxt971alc的对应信号线直接连接，输出数据经网络变压器13f-60ldnl以及rj45接口连接到internet上，从而发送到pc机。图3中dm642的各信号线说明如表1。
2 系统软件设计
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本系统的主程序完成各种寄存器的初始化工作、实时采集并存储摄像机传送来的视频图像，经过dm642的压缩编码，通过网口发送采集的图像数据，通知cpld继续下一次采集直至检测结束。软件设计流程如图4所示。
具体工作过程为：上电后系统程序自动从flash装载到dsp的片内ram中，装载完毕，dm642自动调用程序ram中的代码执行。首先通过i2c总线对a/d芯片saa7113的工作参数进行设置，在图像采集控制电路（由cpld实现）的作用下，saa7113按设定的工作参数获取图像（本系统设定的数据输出流为bt656格式即：y:u：v 4:2：2），地址译码电路（由cpld实现）将数字图像数据重新抽样后存储在片外数据存储器sdram中，经dm642实时压缩处理后，通过网络芯片接口，tcp/ip协议传输到地面的服务器（pc机）。
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视频图像只有通过压缩后才能正确地通过网络传输。本系统的图像压缩采用h.263数字图像压缩算法，由信号处理器dm642来完成。h.263压缩以帧内变换与帧间预测相结合的混合编码技术为核心，适合视频流的实时网络化传输，比h.264算法成熟、稳定，且实现简单。
由于h.263压缩标准只需要cif格式（y:u：v 4∶2∶0）的视频图像，故需将数字化的720×576 4∶2∶2的图像抽样为352×288 4∶2∶0的视频图像，再写入sdram中。重新抽样完成后，再由dm642读取sdram中的数据进行压缩编码，输出的视频码流经网口传输到pc上。
本系统h.263压缩编码设计流程有：编码参数设置，视频数据输入，帧内编码，帧间编码，熵编码和码流输出。编码流程图如图5所示。
3 系统测试及试验结果
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经试验证明，本文介绍的基于dm642的缆索缺陷图像采集及传输系统可以很好地完成缆索表面图像的采集和网络化传输功能，并在pc机上显示，以供图像处理，达到了预期的目标。该系统具有一定的通用性和扩展性，可用作串口、hpi接口、无线传输等多种传输方式的扩展，同时也可用作其他目标对象的缺陷检。
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