新版本HyperLynx VX.2.13速览
西门子eda全球客户支持部门 -客户关怀系列
西门子eda全球客户支持部门从2023年3月份开始推出客户关怀系列技术文章。本系列，我们的产品技术专家将结合电子系统设计软件的新功能和应用热点进行选题，本期主题为新版本hyperlynx vx.2.13速览，敬请参阅！
新版本hyperlynx vx.2.13已于近期在support center上发布，让我们了解一下新版本里面有哪些增强以及新功能。希望通过本期文章的介绍，让大家对vx.2.13的功能有所了解，并对之前老版本里面存在的痛点有所帮助。
hyperlynx串行信号通道设计及验证在vx.2.13中的增强
01ibis-ami
用户可依照以下指定方式，自动量测pam4 (上/中/下)眼图:
指定范围内最大眼高
ibis-ami模型运行数据
自定义门限值
02协议(protocol)合规报告增强
serdes信号通道的时域特性图现在可以在html格式的合规报告中显示。
不需要启动外部波形显示器
可操作平移/缩放等互动指令
方便将报告及详细数据与非hyperlynx用户分享
用户只需选取目标网络以及适用的协议，其他工作将由hyperlynx自动完成。
自动化layout拓朴抽取，在特定区域自动运行全波解析器完成三维建模，进行serdes信号通道仿真，并生成报告。
hyperlynx ddrx界面设计及验证在vx.2.13中的增强
ddr5在dram使用ibis-ami模型来处理接收端组件特有的均衡(equalization)和时钟信号。不同于serdes是在接收端利用数据流还原采样时钟信号，ddr组件使用forward sampling clock (dqs) 信号来降低电路板上的噪声。
ddr5的模型可以是比较准确的新型态clock-forwarded ibis-ami模型(使用分离dqs输入来建立眼图)，或是在形成眼图时假设dqs居中，精确度稍差的non clock-forwarded模型。hyperlynx支持这两种模型。
这里看到一个例子，在一样的均衡条件下，具有clock-forwarding功能的ddr5 ami模型可以有比较张开的眼图，得到比较大的裕量。
大型项目也没问题。这里看到在一块含32个dimm插槽和64个ddr5通道的主板上装了一条dimm的仿真结果。ic使用ibis-ami模型。连接器使用s-参数模型。叠层使用来自z-planner的真实pcb数据。
hyperlynx与xpedition edm的集成在vx.2.13中的增强
在vx.2.13版本中，pcb和仿真数据可以各自检入(check in)和检出(check out)。在整合流程里，pcb和仿真数据是被一起管理，但在仿真流程里，分析的数据可自行检入和检出，以增进效率。
edm让用户在最新版本的设计数据中运行仿真，并透过collaborate和非hyperlynx用户分享仿真结果。edm也让用户能够检出旧版本pcb数据，并进行仿真。
edm collaborate让非hyperlynx用户得以查看仿真结果，加上批注，提交问题，并将这些意见反馈给仿真分析者。仿真结果是以含有超链接的html报告呈现，可以让组织内部和外部的成员查看。
hyperlynx drc在vx.2.13中的增强
01
新增reference via location规则
hyperlynx drc 在vx.2.13新增加了reference via location规则来处理像在bga管脚区域过孔的串扰问题，检查在干扰源和受扰者过孔间是否存在有效的参考信号过孔。用户可自行定义搜寻的角度和距离，也可选择是否在地过孔外也搜寻电源过孔。在现代高速设计里，过孔间的串扰是一重要议题。信号线之间的距离通常较容易控制，但在bga组件扇出的过孔位置经常受到组件脚位所限制。此规则让电路板设计者很快找到可能的问题点，接着视需要决定是否进行详细仿真。
02
高亮多个违规点
hyperlynx drc vx.2.13允许用户选择并同时高亮多个违规的地方。这让电路板设计者可以一次检查一组信号上所有的违规处，藉此正确评估需要重新调整信号布线的区域。
03
automation增强
hyperlynx drc vx.2.13的aom (automation object model)参考指引已新增了python的使用范例。
目前，hyperlynx vx.2.13的安装包在support center已经可以下载，感兴趣的用户可以点击阅读原文进行下载安装，测试文章所提到的新功能。如果有任何的问题，欢迎留言。
西门子支持中心，时刻为您守护！知识库文章，技术视频，支持工具包，现场及视频点播培训，助力您发挥软件的强大功能，赋能您的产品开发流程。西门子支持中心屡获大奖，我们的全球支持工程师团队在分析问题和提供解决方案方面拥有卓越的技能。
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新版本hyperlynx vx.2.13已于近期在support center上发布，让我们了解一下新版本里面有哪些增强以及新功能。希望通过本期文章的介绍，让大家对vx.2.13的功能有所了解，并对之前老版本里面存在的痛点有所帮助。
hyperlynx串行信号通道设计及验证在vx.2.13中的增强
01ibis-ami
用户可依照以下指定方式，自动量测pam4 (上/中/下)眼图:
指定范围内最大眼高
ibis-ami模型运行数据
自定义门限值
02协议(protocol)合规报告增强
serdes信号通道的时域特性图现在可以在html格式的合规报告中显示。
不需要启动外部波形显示器
可操作平移/缩放等互动指令
方便将报告及详细数据与非hyperlynx用户分享
用户只需选取目标网络以及适用的协议，其他工作将由hyperlynx自动完成。
自动化layout拓朴抽取，在特定区域自动运行全波解析器完成三维建模，进行serdes信号通道仿真，并生成报告。
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ddr5在dram使用ibis-ami模型来处理接收端组件特有的均衡(equalization)和时钟信号。不同于serdes是在接收端利用数据流还原采样时钟信号，ddr组件使用forward sampling clock (dqs) 信号来降低电路板上的噪声。
ddr5的模型可以是比较准确的新型态clock-forwarded ibis-ami模型(使用分离dqs输入来建立眼图)，或是在形成眼图时假设dqs居中，精确度稍差的non clock-forwarded模型。hyperlynx支持这两种模型。
这里看到一个例子，在一样的均衡条件下，具有clock-forwarding功能的ddr5 ami模型可以有比较张开的眼图，得到比较大的裕量。
大型项目也没问题。这里看到在一块含32个dimm插槽和64个ddr5通道的主板上装了一条dimm的仿真结果。ic使用ibis-ami模型。连接器使用s-参数模型。叠层使用来自z-planner的真实pcb数据。
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在vx.2.13版本中，pcb和仿真数据可以各自检入(check in)和检出(check out)。在整合流程里，pcb和仿真数据是被一起管理，但在仿真流程里，分析的数据可自行检入和检出，以增进效率。
edm让用户在最新版本的设计数据中运行仿真，并透过collaborate和非hyperlynx用户分享仿真结果。edm也让用户能够检出旧版本pcb数据，并进行仿真。
edm collaborate让非hyperlynx用户得以查看仿真结果，加上批注，提交问题，并将这些意见反馈给仿真分析者。仿真结果是以含有超链接的html报告呈现，可以让组织内部和外部的成员查看。
hyperlynx drc在vx.2.13中的增强
01
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hyperlynx drc 在vx.2.13新增加了reference via location规则来处理像在bga管脚区域过孔的串扰问题，检查在干扰源和受扰者过孔间是否存在有效的参考信号过孔。用户可自行定义搜寻的角度和距离，也可选择是否在地过孔外也搜寻电源过孔。在现代高速设计里，过孔间的串扰是一重要议题。信号线之间的距离通常较容易控制，但在bga组件扇出的过孔位置经常受到组件脚位所限制。此规则让电路板设计者很快找到可能的问题点，接着视需要决定是否进行详细仿真。
02
高亮多个违规点
hyperlynx drc vx.2.13允许用户选择并同时高亮多个违规的地方。这让电路板设计者可以一次检查一组信号上所有的违规处，藉此正确评估需要重新调整信号布线的区域。
03
automation增强
hyperlynx drc vx.2.13的aom (automation object model)参考指引已新增了python的使用范例。
目前，hyperlynx vx.2.13的安装包在support center已经可以下载，感兴趣的用户可以点击阅读原文进行下载安装，测试文章所提到的新功能。如果有任何的问题，欢迎留言。
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