Altera Stratix V GX FPGA实现了与PCIe Gen3的兼容

2013年5月23号,北京——altera公司 (nasdaq: altr)今天宣布,其28 nm stratix® v gx fpga已经收录在最新的pci-sig® integrators名录中,符合pci express® (pcie®) 3.0规范(gen3)要求。在最近的pci-sig实验室测试中,stratix v gx fpga成功通过了全部pci-sig兼容性和互操作性测试,包括stratix v在内的所有三代器件都被收录在pcie integrators名录中。cyclone v和arria v器件含在1.1 (gen 1)和2.0 (gen2)名录中,altera全系列28 nm器件所有三代产品现在均通过了pci-sig的pcie兼容性认证。
今天同时发布的还有,为满足stratix v客户无缝快速设计pcie gen3解决方案的需求,开发了altera直接存储器访问(dma)参考设计。stratix v gx fpga为pcie gen3应用提供了增强协议栈,这些应用对带宽要求非常高,要求以较低的成本和总功耗实现系统集成,提高灵活性。
altera产品营销资深总监patrick dorsey评论说:“stratix v fpga被pcie gen 3 integrators名录收录表明我们的高性能器件非常成功。高性能stratix v和pcie gen3能够一起无缝工作,需要它们的客户现在可以充满信心的设计系统。此外,我们新的dma参考设计简化并加速了高性能pcie gen3x8硬件的开发。”
altera dma参考设计重点突出了需要pcie gen3x8的stratix v设计的功能。通过展示理论最大峰值带宽,参考设计表明altera的gen3解决方案几乎能够实现gen3系统的全部带宽,或者gen3数据速率。而且,通过展示高达11 gb/秒的同时读/写操作,设计显示了客户在实际实现时能够使用多大带宽。dma参考设计的特性包括:
· 与实例设计一同工作的linux驱动
· 峰值吞吐量(250mhz时,256位142周期)
· 7.1 gb/s:背靠背tx存储器写256字节负载
· 7.0 gb/s:背靠背rx读完成吞吐量
· 同时读/写操作:11.4gb/秒
面向pcie gen3的altera stratix v gx fpga
stratix v fpga具有四个硬核pcie gen3x8知识产权(ip)模块。pcie gen3 ip模块支持x1、x2、x4和x8通路配置,每个通路传送速率高达8-gbps,与前一版本的gen2 x8相比,使用gen3 x8通路,吞吐量提高了两倍。与相应的软核实施方案相比,stratix v fpga中的pcie ip硬核模块节省了100,000多个逻辑单元。硬核pcie gen3 ip模块将pcie协议堆栈嵌入到fpga中,包括了收发器模块、物理层、数据链路层和会话层。stratix v fpga的pcie gen3 ip面向pcie基本规范rev 3.0、2.x和1.x。
altera提供其全系列产品全面的pci-sig兼容解决方案,这些产品经过优化满足了关键应用需求。这些解决方案包括支持端点、桥接、交换和根端口功能的可配置pcie ip内核和开发板。
供货信息
altera stratix v gx fpga目前已经开始成品发售。quartus® ii软件13.0版下载中提供dma参考设计。
如果有其他问题,或者需要了解订购信息,请联系您当地的altera销售代表或者授权代理商。
altera简介
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