锁存器和寄存器介绍
锁存器和寄存器
寄存器主要由触发器和一些控制门组成，每个触发器能存放一位 二进制码，存放n位数码，就应该有n位触发器。为保持触发器能正常完成寄存器的功能，还必须用适当的门电路组成控制电路。
锁存器是由电平触发器完成的，n个电平触发器的时钟端连在一起，在时钟脉冲作用下能接收n位二进制信息。
从寄存器数据角度看，锁存器和寄存器的功能是一样的，其区别仅在于锁存器是用电平触发的，而寄存器是用边沿触发器触发的，即寄存器的输出端平时不随输入端的变化而变化，只有在时钟有效时，才将输入端的数据送到输出端;而锁存器的输出端平时总随输入端变化而变化。
寄存器是在时钟沿进行数据的锁存，而锁存器是用电平使能来锁存数据。所以寄存器的q输出端在每个时钟沿都会被更新，而锁存器仅在使能电平有效时才被更新。在fpga设计中建议如果不是强制需求锁存器，则应该尽量使用寄存器。
寄存器按功能可以分为两类，即基本寄存器和移位寄存器。基本寄存器的数据只能并行的输入或输出;移位寄存器中的数据可以在移位脉冲作用下一次逐位右移或左移，数据既可以并行输入并行输出，也可以并行输入串行输出、串行输入串行输出、串行输入并行输出,因其数据输入输出方式非常灵活，所以用途非常广泛。
锁存器
锁存器通常由d触发器构成，在数字电路中，74373是一种常用的8位锁存器，它由使能控制端en、数据锁存控制端g、数据输入端d7~d0和数据输出端q7~q0构成，其逻辑符号与其真值表如下;
例6-13] 74373锁存器的vhdl描述。
分析:通过74373 锁存器的真值表可以看出，当数据锁存控制端g=1且使能控制端en=0时，锁存器把输入端口d的数据送到输出端口; 当数据锁存控制端g=0且使能控制端en =0时，锁存器输出端口将保持前一个状态;当使能控制端en=1时，不管数据锁存控制端g的状态如何，这时锁存器输出端口将处于高阻态。编写74373锁存器的vhdl程序时，需先使用if语句判断en是否等于见 若是，再使用if语句判断g是否等于1，如果g等于1，则将d输入到q中，否则q保持前一状态;当en=0时，则q输出为高阻态。74373 锁存器的vhdl程序编写如下:
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寄存器是在时钟沿进行数据的锁存，而锁存器是用电平使能来锁存数据。所以寄存器的q输出端在每个时钟沿都会被更新，而锁存器仅在使能电平有效时才被更新。在fpga设计中建议如果不是强制需求锁存器，则应该尽量使用寄存器。
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锁存器
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分析:通过74373 锁存器的真值表可以看出，当数据锁存控制端g=1且使能控制端en=0时，锁存器把输入端口d的数据送到输出端口; 当数据锁存控制端g=0且使能控制端en =0时，锁存器输出端口将保持前一个状态;当使能控制端en=1时，不管数据锁存控制端g的状态如何，这时锁存器输出端口将处于高阻态。编写74373锁存器的vhdl程序时，需先使用if语句判断en是否等于见 若是，再使用if语句判断g是否等于1，如果g等于1，则将d输入到q中，否则q保持前一状态;当en=0时，则q输出为高阻态。74373 锁存器的vhdl程序编写如下:
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