Verilog HDL语言简介
verilog hdl语言简介
1．什么是verilog hdl
verilog hdl是硬件描述语言的一种，用于数字电子系统设计。它允许设计者用它来进行各种级别的逻辑设计，可以用它进行数字逻辑系统的仿真验证、时序分析、逻辑综合。它是目前应用最广泛的一种硬件描述语言之一。
2．verilog hdl的历史
verilog hdl是在1983年由gda（gateway design automation）公司的phil moorby首创的。phil moorby后来成为verilog-xl的主要设计者和cadence公司（cadence design system）的第一个合伙人。
在1984年～1985年，moorby设计出了第一个关于verilog-xl的仿真器，1986年，他对verilog hdl的发展又做出了另一个巨大贡献：即提出了用于快速门级仿真的xl算法。
随着verilog-xl算法的成功，verilog hdl语言得到迅速发展。1989年，cadence公司收购了gda公司，verilog hdl语言成为cadence公司的私有财产。1990年，cadence公司决定公开verilog hdl语言，于是成立了ovi（open verilog international）组织来负责verilog hdl语言的发展。
3．verilog hdl的进展
基于verilog hdl的优越性，ieee于1995年制定了verilog hdl的ieee标准，即verilog hdl1364-1995。其后，又在2001年发布了verilog hdl1364-2001标准。
据有关文献报道，目前在美国使用verilog hdl进行设计的工程师大约有60000人，全美国有200多所大学教授用verilog硬件描述语言的设计方法。在我国***地区几乎所有著名大学的电子和计算机工程系都讲授verilog有关的课程。
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据有关文献报道，目前在美国使用verilog hdl进行设计的工程师大约有60000人，全美国有200多所大学教授用verilog硬件描述语言的设计方法。在我国***地区几乎所有著名大学的电子和计算机工程系都讲授verilog有关的课程。
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