集成电路上晶体管结构的那些事儿
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这一期，我们聊一聊集成电路上晶体管结构的那些事儿。
在解释集成电路上晶体管的工作原理之前，我们得先来聊聊最常用的硅（和它元素家族）的特点。
硅原子作为一个大哥，最外层围绕着四个电子。硅原子排列成晶体时，最外层电子正好两两组队，形成稳定的八电子结构，也就是很难游离成为自由电子。缺少了自由电子，纯硅在室温下的导电率就很低，基本就是个绝缘体。
众所周知，集成电路用的硅是半导体，可是纯硅都绝缘了还怎么玩？我们可以在纯净的硅晶体中强行加入比硅活跃的其他原子小弟来增加自由电子，让不纯的硅可以一点点导电但又不怎么导电，这就是半导体。强行加入较活跃原子的过程叫做掺杂，目的就是大幅度提升硅的导电率。掺入容易游离出自由电子的原子，就是n型半导体。掺入电子不容易游离的原子，可以理解为游离出来的自由电荷是缺少电子的空洞正电荷，称为空穴，这种就是p型半导体。
当我们把这两种性质相反的半导体连在一起时，就形成了一个pn结。为什么谈到pn结呢？因为pn结在集成电路中无处不在。不施加外部电压时，pn结无法导电。如果在n这一侧加入巨量的自由电子，让自由电子的浓度高过p型的空穴，这样p型就临时变成了n型，也就能导电了。反向操作的话，只要电压不足够高，pn结没怎么变化，始终不导电，这样还能当作电压保护使用。结构简单的单向导电器件二极管就是利用这个原理。
把两种性质的半导体做成两个pn结的三明治结构，这就是1946年的诺贝尔物理学获奖内容，双极晶体管（简称bjt）。它工作的原理比二极管稍微复杂一点，但依然是通过控制三明治每部分的电压让整个三明治完全导通。bjt导通时电阻比较小，电流比较大。所以在讲究省电的数字集成电路里面，更多使用的是另一种以pn结为基础的晶体管：金属-氧化物-半导体-场效应晶体管，简称mosfet。
mosfet的工作原理看起来也是通过控制不同区域的电压让晶体管导通，可是本质上和btj有极大的差异。
首先，pn结在mosfet里的作用不是用来控制导电，相反是让电流无法通过，只让电流在指定区域里经过。控制电流经过的指定区域就比较特别了，是一个与电流通过方向垂直的金属层/绝缘层/半导体的三明治结构（mos结构）。例如对一个p型半导体，在金属层上接正电压，就会通过绝缘层形成一个垂直方向的电场。在电场作用下，正电荷被推远，负电荷也就是电子被拉向半导体和绝缘层的接触面上。当电压足够高，电场足够强时，p型半导体和绝缘层的接触面上就不再是p型了，而出现了非常非常非常薄的n型半导体层，电子就可以在其中移动了。
这层受mos结构控制出现的反类型半导体的电荷通道channel就叫做沟道。金属层就是控制沟道的栅极gate（g极）。我们在半导体制造工艺上常说的xx纳米工艺，本意就是指g极的长度，也可以简单理解为沟道的长度。
在沟道的两端接上和移动电荷同型的半导体，再在它们上加上一个和沟道水平的电场，这些游离电荷（载流子）就能从一端出发到达另一端了。出发端是电荷（载流子）的源头，叫做源极source（s极）。到达端接收到漏过沟道的电荷，叫做漏极drain（d极）。）就能从一端出发到达另一端了。出发端是电荷（载流子）的源头，叫做源极source（s极）。到达端接收到漏过沟道的电荷，叫做漏极drain（d极）。（载流子）就能从一端出发到达另一端了。出发端是电荷（载流子）的源头，叫做源极source（s极）。到达端接收到漏过沟道的电荷，叫做漏极drain（d极）。
在mos结构中，水平方向的电场决定有没有电流可以流通，而垂直方向的电场控制电流能不能通过。这就是mos结构的场效应晶体管，所以它叫做mosfet。当一个mosfet关断时，几乎没有电流通过。而导通时，电流也仅仅在沟道里流通。所以mosfet的工作电流相对小，换句话说，有着省电的天然优势。
在芯片制造上，mosfet还有另一个巨大优势。一个完整的cmos里，一个n型和一个p型mosfet同步制造一体成型。它们的g极和d极各自连接在一起。当g极上给逻辑状态1的时候，d极就能出现状态0的响应。一个二进制逻辑上的反向器就这么简单而有极其紧凑地做出来了。这个紧凑的结构就是经典的cmos。
凭借省电和制造上的两大优势，mosfet自然而然就成了集成电路中的绝对主力老大哥了。
finfet横空出世
随着芯片制程越来越小，传统平面结构的mosfet已经难以达到设计指标。因为晶体管尺寸不断缩小，s与d间的沟道就不断变短。当沟道短到一定程度时，即便没有施加电压，s和d也会因为传说中的量子效应变得微弱导电，直接来说就是随时随地都在“漏电”。这就是半导体器件物理中说的“短沟道效应”。
为了极大程度上抵消掉短沟道效应，华裔科学家胡正明教授于1999年发明的3d鳍式场效应晶体管的新型mosfet构造，简称finfet。而finfet也成为了半导体工业中延续摩尔定律的革命性技术。
在finfet的构造中，首先是沟道的水平宽度大幅缩减，然后增加其高度，呈现出类似鱼鳍的形状，这也正是finfet名字的由来。一句话解释：finfet把平面mosfet的沟道立了起来。因此栅极被设计成了叉状3d架构紧紧包裹住“鱼鳍”状的沟道。如此一来，finfet的栅极就可以在传统的上方以及垂直的两侧共同控制沟道的导通与关断。这样不仅能够改善电路控制和减少漏电流来抵消掉短沟道效应，同时还能让晶体管整体结构中的长度得以大幅缩减，从而进一步帮助缩小芯片单位面积。
原理听起来很简单是不是，但如何在硅片上制造这些“鱼鳍”却相当困难。单个“鱼鳍”的尺寸是最小栅长的0.67倍。举个具体的例子：对于22nm的工艺，单个“鱼鳍”的宽度仅为14.67nm，这个尺寸远小于最精密浸入式***所能制造的最小尺寸。
这里是finfet的工艺流程图，只是简单描述了前段制造流程。大家可以脑补一下完整制造过程的复杂程度。
再说说器件材料上的差异吧。有别与传统平面mosfet，finfet的沟道通常较少掺杂甚至不掺杂，比起传统较多掺杂的平面器件，载流子的迁移率得到了大幅度的提高，也就是说单位电流更大。因为有效抵消掉短沟道效应和增强了栅极控制能力，finfet还可以使用更厚的氧化层来减少栅漏电流。
随着finfet技术一路从22nm用到5nm芯片，俨然成为了先进芯片市场上的主流，也取得了商业上的巨大成功。但当半导体制造工艺推进到3nm时，静态电流泄露的问题变得越来越严重，棘手的短沟道效应再次出现。
gaa技术：鳍式的“再进化”
既然短沟道效应又出现了，那我们再按照finfet的思路走一遍试试？如果finfet三面包住还不够，我们干脆就把它四面全部都包起来！没错，gaa技术就是用的这个方式突破了finfet的瓶颈。
gaafet，全称gate-all-around fet是通过堆叠多个水平的纳米片或纳米线，并将mos结构包裹住纳米片（线）的每一个侧面，让纳米片（线）的每个表面全是沟道的设计理念。
相比finfet，gaa技术能够让晶体管得以承载更多的电流。在finfet中，需要通过多个垂直的“鱼鳍”并排放置以增加电流，gaa则通过水平堆叠实现了对finfet的全面增强。在栅极控制能力方面，四面全包裹也比三面包裹的finfet更胜一筹，因此gaa技术能够更为精确地控制电流。
毫无疑问在当下，gaa对解决3nm及以下尺寸的半导体制造问题尤为关键。在3nm到2nm的阶段，业界最强的三家晶圆制造企业都不同程度上选择了gaa。
新思科技作为覆盖了从硅的生产制造、芯片设计及制造的全流程eda和ip解决方案的全球领导者，也与晶圆厂长期紧密合作。通过dtco (design technology co-optimization)协同优化先进的工艺技术解决方案，积极支持更先进的新型晶体管工艺。
本着延续摩尔定律的目标，以从平面向空间的发展逻辑，许多创新的架构设计如今也在崭露头角：如forksheet、cfet、bizen晶体管等等。也许未来的晶体管的主流架构，就在这些创新方案之中，让我们拭目以待吧！
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电机热装配工艺介绍
对机器学习的理解和用Python实现的机器学习样例分析
黑芝麻智能持续推动自动驾驶产业发展
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集成电路上晶体管结构的那些事儿
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压电螺钉及二维镜片调节架的特点及技术参数
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在解释集成电路上晶体管的工作原理之前，我们得先来聊聊最常用的硅（和它元素家族）的特点。
硅原子作为一个大哥，最外层围绕着四个电子。硅原子排列成晶体时，最外层电子正好两两组队，形成稳定的八电子结构，也就是很难游离成为自由电子。缺少了自由电子，纯硅在室温下的导电率就很低，基本就是个绝缘体。
众所周知，集成电路用的硅是半导体，可是纯硅都绝缘了还怎么玩？我们可以在纯净的硅晶体中强行加入比硅活跃的其他原子小弟来增加自由电子，让不纯的硅可以一点点导电但又不怎么导电，这就是半导体。强行加入较活跃原子的过程叫做掺杂，目的就是大幅度提升硅的导电率。掺入容易游离出自由电子的原子，就是n型半导体。掺入电子不容易游离的原子，可以理解为游离出来的自由电荷是缺少电子的空洞正电荷，称为空穴，这种就是p型半导体。
当我们把这两种性质相反的半导体连在一起时，就形成了一个pn结。为什么谈到pn结呢？因为pn结在集成电路中无处不在。不施加外部电压时，pn结无法导电。如果在n这一侧加入巨量的自由电子，让自由电子的浓度高过p型的空穴，这样p型就临时变成了n型，也就能导电了。反向操作的话，只要电压不足够高，pn结没怎么变化，始终不导电，这样还能当作电压保护使用。结构简单的单向导电器件二极管就是利用这个原理。
把两种性质的半导体做成两个pn结的三明治结构，这就是1946年的诺贝尔物理学获奖内容，双极晶体管（简称bjt）。它工作的原理比二极管稍微复杂一点，但依然是通过控制三明治每部分的电压让整个三明治完全导通。bjt导通时电阻比较小，电流比较大。所以在讲究省电的数字集成电路里面，更多使用的是另一种以pn结为基础的晶体管：金属-氧化物-半导体-场效应晶体管，简称mosfet。
mosfet的工作原理看起来也是通过控制不同区域的电压让晶体管导通，可是本质上和btj有极大的差异。
首先，pn结在mosfet里的作用不是用来控制导电，相反是让电流无法通过，只让电流在指定区域里经过。控制电流经过的指定区域就比较特别了，是一个与电流通过方向垂直的金属层/绝缘层/半导体的三明治结构（mos结构）。例如对一个p型半导体，在金属层上接正电压，就会通过绝缘层形成一个垂直方向的电场。在电场作用下，正电荷被推远，负电荷也就是电子被拉向半导体和绝缘层的接触面上。当电压足够高，电场足够强时，p型半导体和绝缘层的接触面上就不再是p型了，而出现了非常非常非常薄的n型半导体层，电子就可以在其中移动了。
这层受mos结构控制出现的反类型半导体的电荷通道channel就叫做沟道。金属层就是控制沟道的栅极gate（g极）。我们在半导体制造工艺上常说的xx纳米工艺，本意就是指g极的长度，也可以简单理解为沟道的长度。
在沟道的两端接上和移动电荷同型的半导体，再在它们上加上一个和沟道水平的电场，这些游离电荷（载流子）就能从一端出发到达另一端了。出发端是电荷（载流子）的源头，叫做源极source（s极）。到达端接收到漏过沟道的电荷，叫做漏极drain（d极）。）就能从一端出发到达另一端了。出发端是电荷（载流子）的源头，叫做源极source（s极）。到达端接收到漏过沟道的电荷，叫做漏极drain（d极）。（载流子）就能从一端出发到达另一端了。出发端是电荷（载流子）的源头，叫做源极source（s极）。到达端接收到漏过沟道的电荷，叫做漏极drain（d极）。
在mos结构中，水平方向的电场决定有没有电流可以流通，而垂直方向的电场控制电流能不能通过。这就是mos结构的场效应晶体管，所以它叫做mosfet。当一个mosfet关断时，几乎没有电流通过。而导通时，电流也仅仅在沟道里流通。所以mosfet的工作电流相对小，换句话说，有着省电的天然优势。
在芯片制造上，mosfet还有另一个巨大优势。一个完整的cmos里，一个n型和一个p型mosfet同步制造一体成型。它们的g极和d极各自连接在一起。当g极上给逻辑状态1的时候，d极就能出现状态0的响应。一个二进制逻辑上的反向器就这么简单而有极其紧凑地做出来了。这个紧凑的结构就是经典的cmos。
凭借省电和制造上的两大优势，mosfet自然而然就成了集成电路中的绝对主力老大哥了。
finfet横空出世
随着芯片制程越来越小，传统平面结构的mosfet已经难以达到设计指标。因为晶体管尺寸不断缩小，s与d间的沟道就不断变短。当沟道短到一定程度时，即便没有施加电压，s和d也会因为传说中的量子效应变得微弱导电，直接来说就是随时随地都在“漏电”。这就是半导体器件物理中说的“短沟道效应”。
为了极大程度上抵消掉短沟道效应，华裔科学家胡正明教授于1999年发明的3d鳍式场效应晶体管的新型mosfet构造，简称finfet。而finfet也成为了半导体工业中延续摩尔定律的革命性技术。
在finfet的构造中，首先是沟道的水平宽度大幅缩减，然后增加其高度，呈现出类似鱼鳍的形状，这也正是finfet名字的由来。一句话解释：finfet把平面mosfet的沟道立了起来。因此栅极被设计成了叉状3d架构紧紧包裹住“鱼鳍”状的沟道。如此一来，finfet的栅极就可以在传统的上方以及垂直的两侧共同控制沟道的导通与关断。这样不仅能够改善电路控制和减少漏电流来抵消掉短沟道效应，同时还能让晶体管整体结构中的长度得以大幅缩减，从而进一步帮助缩小芯片单位面积。
原理听起来很简单是不是，但如何在硅片上制造这些“鱼鳍”却相当困难。单个“鱼鳍”的尺寸是最小栅长的0.67倍。举个具体的例子：对于22nm的工艺，单个“鱼鳍”的宽度仅为14.67nm，这个尺寸远小于最精密浸入式***所能制造的最小尺寸。
这里是finfet的工艺流程图，只是简单描述了前段制造流程。大家可以脑补一下完整制造过程的复杂程度。
再说说器件材料上的差异吧。有别与传统平面mosfet，finfet的沟道通常较少掺杂甚至不掺杂，比起传统较多掺杂的平面器件，载流子的迁移率得到了大幅度的提高，也就是说单位电流更大。因为有效抵消掉短沟道效应和增强了栅极控制能力，finfet还可以使用更厚的氧化层来减少栅漏电流。
随着finfet技术一路从22nm用到5nm芯片，俨然成为了先进芯片市场上的主流，也取得了商业上的巨大成功。但当半导体制造工艺推进到3nm时，静态电流泄露的问题变得越来越严重，棘手的短沟道效应再次出现。
gaa技术：鳍式的“再进化”
既然短沟道效应又出现了，那我们再按照finfet的思路走一遍试试？如果finfet三面包住还不够，我们干脆就把它四面全部都包起来！没错，gaa技术就是用的这个方式突破了finfet的瓶颈。
gaafet，全称gate-all-around fet是通过堆叠多个水平的纳米片或纳米线，并将mos结构包裹住纳米片（线）的每一个侧面，让纳米片（线）的每个表面全是沟道的设计理念。
相比finfet，gaa技术能够让晶体管得以承载更多的电流。在finfet中，需要通过多个垂直的“鱼鳍”并排放置以增加电流，gaa则通过水平堆叠实现了对finfet的全面增强。在栅极控制能力方面，四面全包裹也比三面包裹的finfet更胜一筹，因此gaa技术能够更为精确地控制电流。
毫无疑问在当下，gaa对解决3nm及以下尺寸的半导体制造问题尤为关键。在3nm到2nm的阶段，业界最强的三家晶圆制造企业都不同程度上选择了gaa。
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