电子万年历设计方案(2)
4.1 系统核心部分——闪电存储型器件at89s52
4.1.1 at89s52具有下列主要性能：
8kb可改编程序flash存储器（可经受1000次的写入/擦除周期）
全静态工作：0hz～24mhz
三级程序存储器保密
128×8字节内部ram
32条可编程i/o线
2个16位定时器/计数器
6个中断源
可编程串行通道
片内时钟振荡器
4.1.2 at89s52的引脚及功能
at89s52单片机的管脚说明如图4-2所示。
（图4-2 at89s52的管脚）
(1) 主要电源引脚
①vcc 电源端
②gnd 接地端
(2) 外接晶体引脚xtal1和xtal2
①xtal1 接外部晶体的一个引脚。在单片机内部，它是构成片内振荡器的反相放大器的输入端。当采用外部振荡器时，该引脚接收振荡器的信号，既把此信号直接接到内部时钟发生器的输入端。
②xtal2 接外部晶体的另一个引脚。在单片机内部，它是上述振荡器的反相放大器的输出端。采用外部振荡器时，此引脚应悬浮不连接。
(3) 控制或与其它电源复用引脚rst、ale//prog、/psen和/ea/vpp
①rst 复位输入端。 当振荡器运行时，在该引脚上出现两个机器周期的高电平将使单片机复位。
②ale//prog 当访问外部存储器时，ale（地址锁存允许）的输出用于锁存地址的低位字节。即使不访问外部存储器，ale端仍以不变的频率（此频率为振荡器频率的1/6）周期性地出现正脉冲信号。因此，它可用作对外输出的时钟，或用于定时目的。然而要注意的是：每当访问外部数据存储器时，将跳过一个ale脉冲。在对flash存储器编程期间，该引脚还用于输入编程脉冲（/prog）。
③/psen 程序存储允许（/psen）输出是外部程序存储器的读选通信号。当at89s52/lv52由外部程序存储器取指令（或常数）时，每个机器周期两次/psen有效（既输出2个脉冲）。但在此期间内，每当访问外部数据存储器时，这两次有效的/psen信号将不出现。
④/ea/vpp 外部访问允许端。要使cpu只访问外部程序存储器（地址为0000h～ffffh），则/ea端必须保持低电平（接到gnd端）。当/ea端保持高电平（接vss端）时，cpu则执行内部程序存储器中的程序。
（4）输入/输出引脚 p0.0～p0.7、p1.0～p1.7、p2.0～p2.7 和p3.0～p3.7
①p0端口（p0.0～ p0.7） p0是一个8位漏极开路型双向i/o端口。作为输出口用时，每位能以吸收电流的方式驱动8个ttl输入，对端口写1时，又可作高阻抗输入端用。
②p1端口（p1.0～ p1.7） p1是一个带有内部上拉电阻的8位双向i/o端口。p1的输出缓冲器可驱动（吸收或输出电流方式）4个ttl输入。对端口写1时，通过内部的上拉电阻把端口拉到高电位，这时可用作输入口。作输入口时，因为有内部的上拉电阻，那些被外部信号拉低的引脚会输出一个电流。
③p2端口 （p2.0～p2.7） p2是一个带有内部上拉电阻的8位双向i/o端口。p2的输出缓冲器可驱动（吸收或输出电流方式）4个ttl输入。对端口写1时，通过内部的上拉电阻把端口拉到高电位，这时可用作输入口。p2作输入口使用时，因为有内部的上拉电阻，那些被外部信号拉低的引脚会输出一个电流。 ④p3端口（p3.0～p3.7） p3口管脚是8个带内部上拉电阻的双向i/o口，可接收输出4个ttl门电流。当p3口写入“1”后，它们被内部上拉为高电平，并用作输入。作为输入，由于外部下拉为低电平，p3口将输出电流，这是由于上拉的缘故。
p3口也可作为at89s52的一些特殊功能，这些特殊功能见表4-1。
（表4-1 p3端口的特殊功能）
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4.1.2 at89s52的引脚及功能
at89s52单片机的管脚说明如图4-2所示。
（图4-2 at89s52的管脚）
(1) 主要电源引脚
①vcc 电源端
②gnd 接地端
(2) 外接晶体引脚xtal1和xtal2
①xtal1 接外部晶体的一个引脚。在单片机内部，它是构成片内振荡器的反相放大器的输入端。当采用外部振荡器时，该引脚接收振荡器的信号，既把此信号直接接到内部时钟发生器的输入端。
②xtal2 接外部晶体的另一个引脚。在单片机内部，它是上述振荡器的反相放大器的输出端。采用外部振荡器时，此引脚应悬浮不连接。
(3) 控制或与其它电源复用引脚rst、ale//prog、/psen和/ea/vpp
①rst 复位输入端。 当振荡器运行时，在该引脚上出现两个机器周期的高电平将使单片机复位。
②ale//prog 当访问外部存储器时，ale（地址锁存允许）的输出用于锁存地址的低位字节。即使不访问外部存储器，ale端仍以不变的频率（此频率为振荡器频率的1/6）周期性地出现正脉冲信号。因此，它可用作对外输出的时钟，或用于定时目的。然而要注意的是：每当访问外部数据存储器时，将跳过一个ale脉冲。在对flash存储器编程期间，该引脚还用于输入编程脉冲（/prog）。
③/psen 程序存储允许（/psen）输出是外部程序存储器的读选通信号。当at89s52/lv52由外部程序存储器取指令（或常数）时，每个机器周期两次/psen有效（既输出2个脉冲）。但在此期间内，每当访问外部数据存储器时，这两次有效的/psen信号将不出现。
④/ea/vpp 外部访问允许端。要使cpu只访问外部程序存储器（地址为0000h～ffffh），则/ea端必须保持低电平（接到gnd端）。当/ea端保持高电平（接vss端）时，cpu则执行内部程序存储器中的程序。
（4）输入/输出引脚 p0.0～p0.7、p1.0～p1.7、p2.0～p2.7 和p3.0～p3.7
①p0端口（p0.0～ p0.7） p0是一个8位漏极开路型双向i/o端口。作为输出口用时，每位能以吸收电流的方式驱动8个ttl输入，对端口写1时，又可作高阻抗输入端用。
②p1端口（p1.0～ p1.7） p1是一个带有内部上拉电阻的8位双向i/o端口。p1的输出缓冲器可驱动（吸收或输出电流方式）4个ttl输入。对端口写1时，通过内部的上拉电阻把端口拉到高电位，这时可用作输入口。作输入口时，因为有内部的上拉电阻，那些被外部信号拉低的引脚会输出一个电流。
③p2端口 （p2.0～p2.7） p2是一个带有内部上拉电阻的8位双向i/o端口。p2的输出缓冲器可驱动（吸收或输出电流方式）4个ttl输入。对端口写1时，通过内部的上拉电阻把端口拉到高电位，这时可用作输入口。p2作输入口使用时，因为有内部的上拉电阻，那些被外部信号拉低的引脚会输出一个电流。 ④p3端口（p3.0～p3.7） p3口管脚是8个带内部上拉电阻的双向i/o口，可接收输出4个ttl门电流。当p3口写入“1”后，它们被内部上拉为高电平，并用作输入。作为输入，由于外部下拉为低电平，p3口将输出电流，这是由于上拉的缘故。
p3口也可作为at89s52的一些特殊功能，这些特殊功能见表4-1。
（表4-1 p3端口的特殊功能）
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