Xilinx发布Vivado 2015.1版加速系统验证
2015年5月5日，中国北京 - all programmable技术和器件的全球领先企业赛灵思公司（xilinx， inc. （nasdaq:xlnx））今天宣布推出可加速系统验证的vivado®设计套件2015.1版。该版本具备多项可加速全可编程fpga和soc开发及部署的主要先进功能。全新版本包含vivado实验室版本 （ vivado lab edition）、加速的vivado仿真器与第三方仿真流程、交互式跨时钟域（cdc）分析以及赛灵思软件开发套件（sdk）提供的系统性能分析。
全新的vivado实验室版本
vivado实验室版本是一款免费的轻量级vivado设计套件的编程与调试版本。该实验室版本包含vivado器件编程器、vivado逻辑与串行i/o分析器以及内存调试工具，专门针对无需全功能vivado设计套件的实验室环境。vivado实验室版本是比全功能vivado设计套件小75%的简易版，大幅缩短了实验室的设置时间，并减少了系统内存需求。对需要通过以太网进行远程调试或编程的设计团队来说，vivado 设计套件2015.1版还提供了独立的硬件服务器，其大小还不到完整版vivado设计版本的1%。
vivado仿真器及第三方仿真流程
vivado设计套件2015.1版还提升了仿真流程，可将logicore™ip编译时间缩短2倍以上，让整体仿真性能比此前版本快20%。新版本还全面集成了赛灵思联盟计划成员aldec、cadence design systems、mentor graphics和synopsys所提供的仿真流程。
aldec公司的ceo stanley hyduke博士表示：“利用赛灵思vivado 工具指令语言（tcl）存储基础架构，aldec现在能在vivado设计套件中全面集成riviera-pro和active-hdl。这种独特的集成功能将给客户带来极为简便的易用性优势。”
交互式跨时钟域分析
赛灵思还提供交互式cdc分析功能，进一步扩展了其先进的验证功能组合。该功能支持设计人员在设计早期阶段调试cdc问题，从而减少了昂贵的系统内调试周期，提升了生产力。结合vivado设计套件的交互式时序分析和交叉探测特性，cdc分析功能可提供强大的时序分析和调试功能，并加速产品上市进程。
赛灵思sdk加入先进的系统内性能分析与验证功能
为加速开发zynq®-7000全可编程soc，赛灵思针对裸机和linux应用扩展了其系统性能分析工具套件。赛灵思sdk现使嵌入式软件开发人员能够分析其soc设计的性能和带宽，包括处理器子系统（ps）的关键性能参数，以及ps、可编程逻辑（pl）和外部存储器之间的带宽分析。采用axi流量生成器的系统建模设计则可用于zynq-7000全可编程soc zc702和zc706评估板。
供货情况
vivado设计套件2015.1版可为赛灵思7系列fpga与soc以及ultrascale™器件提供支持，现已开始供货。欢迎在以下网址下载vivado 设计套件2015.1版：china.xilinx.com/download。如需了解更多信息，欢迎观看vivado 2015.1最新消息的快速入门视频，报名参加培训，并充分利用ultrafast设计方法以及基于vivado设计套件的目标参考设计，从而快速提高生产力。
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aldec公司的ceo stanley hyduke博士表示：“利用赛灵思vivado 工具指令语言（tcl）存储基础架构，aldec现在能在vivado设计套件中全面集成riviera-pro和active-hdl。这种独特的集成功能将给客户带来极为简便的易用性优势。”
交互式跨时钟域分析
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供货情况
vivado设计套件2015.1版可为赛灵思7系列fpga与soc以及ultrascale™器件提供支持，现已开始供货。欢迎在以下网址下载vivado 设计套件2015.1版：china.xilinx.com/download。如需了解更多信息，欢迎观看vivado 2015.1最新消息的快速入门视频，报名参加培训，并充分利用ultrafast设计方法以及基于vivado设计套件的目标参考设计，从而快速提高生产力。
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