高云半导体推出GW2A系列FPGA芯片的DDR类储存器接口解决方案
山东济南，2017年10月10日讯，山东高云半导体科技有限公司（以下简称“山东高云半导体”）今天宣布推出基于中密度晨熙ⓡ家族的gw2a系列fpga芯片的ddr类储存器接口ip核初级版（gowin memory interface ip），包括相关ip软核、参考设计及开发板等完整解决方案。
高云ddr类储存器接口ip核初级版目前是一个通用的ddr2存储器接口ip，兼容jesd79-2标准。该ip包含通用的ddr2内存控制器（memory controller，mc）与对应的物理层接口（physical interface，phy）。后续升级版会支持晨熙ⓡ家族的gw2ar系列内嵌ddr类储存器式fpga，功能升级将延及ddr1、ddr3内存控制器与对应的物理层接口。
高云ddr类储存器接口ip核初级版为用户提供一个通用的用户命令接口，另一端通过phy连接至内存芯片，完成用户对存储器的访存要求。“高云ddr类储存器接口软核品种丰富，能支持目前市场上的主流ddr类储存器。”高云半导体软核研发部门负责人高级经理高彤军先生解释说，“目前推向市场的ip核初级版已经能够满足我们很多客户的应用要求，但是还远远没有达到高云器件的潜力，我们最终目标速度是达到800mbps到1gbps的范围。”
“我们提供简明易用的ip调用界面，同时提供可用于验证ddr2控制器ip性能的开发板和参考设计。”高云半导体市场副总裁兼中国区销售总监黄俊先生表示，“高云半导体会持续在ip核的开发方面加大投入，旨在提高用户fpga的设计余量和整体系统的可靠性，同时缩短用户的设计周期，可以让广大用户尽快熟悉国产fpga的架构，逐渐认同国产fpga品牌的品质和良好的技术支持服务。”
ip主要特征
ddr2 mc与phy的时钟比例为1：2；
支持存储器数据路径宽度为8、16、24、32、40、48、56、64和72位；
支持单列udimm和sodimm内存模块；
支持x4、x8和x16两种数据宽度的内存芯片；
可编程突发长度4或8；
可配置的cl；
可配置的cwl；
可配置的tfaw；
可配置的tras；
可配置的trcd；
可配置的trfc；
可配置的trrd；
可配置的trtp；
可配置的twtr；
支持动态片上终端odt的控制；
支持自动刷新和用户启动刷新，自动刷新间隔可配置。
ip工作频率
ddr2 sdram数据速率目前为500mbps~560mbps；
ip整体结构
高云ddr类储存器接口ip核的基本结构，包含memory controller、physical interface等主要模块。图中的user design block 是fpga中需要与外部ddr2 sdram芯片所连接的用户设计。
gw2ar、gw2a系列fpga
gw2ar系列为内嵌ddr类储存器式fpga，gw2a系列fpga支持外挂ddr类储存器。其中，gw2ar-18k lq176内嵌128m ddr1；gw2a-18kbga封装与 gw2a-55k bga封装支持外挂ddr2。
开发板与参考设计
高云ddr类储存器接口ip核初级版， 参考设计及开发板支持gw2a-18k/55k bga封装fpga对接通用ddr2存储器，后续升级版会支持gw2ar系列内嵌ddr类储存器式fpga，功能升级将延及ddr1、ddr3内存控制器与对应的物理层接口。
关于山东高云半导体：
山东高云半导体科技有限公司于2014年3月成立，位于济南高新区齐鲁软件园，作为广东高云半导体科技股份有限公司的全资子公司，山东高云半导体致力于国产fpga解决方案并推动其产业化，旨在推出具有核心自主知识产权的民族品牌fpga芯片。
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高云ddr类储存器接口ip核初级版目前是一个通用的ddr2存储器接口ip，兼容jesd79-2标准。该ip包含通用的ddr2内存控制器（memory controller，mc）与对应的物理层接口（physical interface，phy）。后续升级版会支持晨熙ⓡ家族的gw2ar系列内嵌ddr类储存器式fpga，功能升级将延及ddr1、ddr3内存控制器与对应的物理层接口。
高云ddr类储存器接口ip核初级版为用户提供一个通用的用户命令接口，另一端通过phy连接至内存芯片，完成用户对存储器的访存要求。“高云ddr类储存器接口软核品种丰富，能支持目前市场上的主流ddr类储存器。”高云半导体软核研发部门负责人高级经理高彤军先生解释说，“目前推向市场的ip核初级版已经能够满足我们很多客户的应用要求，但是还远远没有达到高云器件的潜力，我们最终目标速度是达到800mbps到1gbps的范围。”
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