如何选择旁路电容
旁路电容并不是十分理想的。
每个电容包括一个寄生串联电感，称为引脚电感，封装电感或安装电感。
每个电容还包括寄生串联电阻，称为等效串联电阻，它的作用与引脚电感一样。削弱了电容的效果。esr是一个实数阻抗，而且不是频率函数。它的作用就像一个普通的电阻，与电容串联。
每个旁路电容对温度都是敏感的。电介质的特性随温度明显地改变，导致电容的容量出现大的摆动。
如果给旁路电容加上太高的电压，电容就会爆炸或短路。
下面的小节将详细讨论这些缺陷。
1、电容的等效串联电阻和引脚电感
等效串联电阻像一个电阻一样，与电容串联。引脚电感像一电感线圈一样，与同一个电容串联。它们共同发挥作用，降低了电容作为一个旁路元件的效果。
作为频率的一个函数，电容的完整阻抗方程是：
其中：esr=等效串联电阻，ω
c=电容，f
l=引脚电感，h
x（f）=在频率f（hz）时的阻抗大小，ω
上式计算了图8.9中电容c2和电容阵列c3的曲线。图8.9中假设c2和c3电容阵列的每个元件的esr都为0.1欧，总的电路板面积为10in的2次方，电源的和地之间有0.01in厚的fr-4电介质。
图8.9显示，旁路电路的谐振频率大约是300mhz，这是由于电容阵列的引脚电感和电源与地之间的电容而产生的。因为这个设计的数字转折频率低于100mhz，因此不必担心。如果数字转折频率比较高，试试用表面贴装的电容阵列，其电感比较低，提高了谐振频率并降低了幅度。
生产商的数据手册上并不总是有esr参数，但它是非常重要的。不要相邻销售人员告诉你的指标，要拿到书面形式的说明。
要测量esr，可以使用图6.14所示的测量装置，与测量一个端接电阻的电感方法相同。
如图6.14所示，当我们把一个旁路电容c放在被测设备上时，期望有好的，干净的rc上升时间。我们希望得到大的源端阻抗，如1k。在图6.14的测试装置中，源端阻抗小，因此得到一个完全不同的结果。rc上升时间加快，引脚电感和esr的旁路应用中，通常源端阻抗是1欧数量级的，速度是在纳秒，能直接测量引脚电感和esr的影响。在数字旁路应用中，通常源端阻抗是1欧数量级的，速度是在纳秒范围的，因此这样考虑旁路元件的方法是合理的。
图8.11的典型画出了一个实际的0.1uf旁路电容的阶跃响应。响应分别采用10ns/刻度和2ns/刻度绘出。两个曲线图分别把测试夹具的开路响应和被测电容的响应叠加在一起。
阶跃响应显示了三个明显的特征：一个尖峰、一个阶跃和一条慢的完整斜坡。通过正确地分折这些特性，可以确定待测器件的引脚电感，esr和电容。
1、起初的2ns是一个短的尖峰。产生这个尖峰是由于引脚电感的作用。我们可以用尖峰下的面积来估算引脚电感。
其中：rs=测试夹具的源端阻抗，ω
a=尖峰下的面积v-s
△v=测试夹具的开路阶跃电压，v
l=引脚电感，h
2、紧接在尖峰之后的波形相对平坦，偏移在零以上。这种形态是由电容的esr引起的，在这个时刻，电容还没有开放充电。在这个时刻，电容的一个好模型是只有esr直接连接到地。由测试夹具的源端阻抗插进电容的esr形成的电阻分压器，所产生的电压近似与esr成正比。
其中：rs=测试夹具的源端电阻，ω
x=尖峰后测量的阶跃电压，v
△v=测试夹具的开路阶跃电压，v
在阶跃保持之后，慢慢地倾斜增加。这是由于电容慢慢地充电的效果。充电速率dv/dt等于充电电流除以电容。充电电流约等于测试电路的开路电压除以源端阻抗。
其中：r=测试夹具的源端电阻，ω
x=尖峰后测量的阶跃电压，v
△v=测试夹具的开路阶跃电压，v
dv/dt=斜坡的充电速率，v/s
c=电容，f
当查看尖峰时候，记住引脚电感和esr都是在该时刻起作用的。如果首先计算esr，然后当测量尖峰下面积时即可减去它的影响。图8.11中的2ns/刻度上显示的三条线分别是测试夹具开路波形、直接测量响应波形、直接测量响应的副本按比例减去开路波形的副本。这种减法解决了esr的影响。这里的减法和面积测量是使用tektronx 11403数字示波器的功能进行的。
图8.11的响应表明引脚电感是4nh，esr是1.1欧，电容是0.072uf。
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每个电容还包括寄生串联电阻，称为等效串联电阻，它的作用与引脚电感一样。削弱了电容的效果。esr是一个实数阻抗，而且不是频率函数。它的作用就像一个普通的电阻，与电容串联。
每个旁路电容对温度都是敏感的。电介质的特性随温度明显地改变，导致电容的容量出现大的摆动。
如果给旁路电容加上太高的电压，电容就会爆炸或短路。
下面的小节将详细讨论这些缺陷。
1、电容的等效串联电阻和引脚电感
等效串联电阻像一个电阻一样，与电容串联。引脚电感像一电感线圈一样，与同一个电容串联。它们共同发挥作用，降低了电容作为一个旁路元件的效果。
作为频率的一个函数，电容的完整阻抗方程是：
其中：esr=等效串联电阻，ω
c=电容，f
l=引脚电感，h
x（f）=在频率f（hz）时的阻抗大小，ω
上式计算了图8.9中电容c2和电容阵列c3的曲线。图8.9中假设c2和c3电容阵列的每个元件的esr都为0.1欧，总的电路板面积为10in的2次方，电源的和地之间有0.01in厚的fr-4电介质。
图8.9显示，旁路电路的谐振频率大约是300mhz，这是由于电容阵列的引脚电感和电源与地之间的电容而产生的。因为这个设计的数字转折频率低于100mhz，因此不必担心。如果数字转折频率比较高，试试用表面贴装的电容阵列，其电感比较低，提高了谐振频率并降低了幅度。
生产商的数据手册上并不总是有esr参数，但它是非常重要的。不要相邻销售人员告诉你的指标，要拿到书面形式的说明。
要测量esr，可以使用图6.14所示的测量装置，与测量一个端接电阻的电感方法相同。
如图6.14所示，当我们把一个旁路电容c放在被测设备上时，期望有好的，干净的rc上升时间。我们希望得到大的源端阻抗，如1k。在图6.14的测试装置中，源端阻抗小，因此得到一个完全不同的结果。rc上升时间加快，引脚电感和esr的旁路应用中，通常源端阻抗是1欧数量级的，速度是在纳秒，能直接测量引脚电感和esr的影响。在数字旁路应用中，通常源端阻抗是1欧数量级的，速度是在纳秒范围的，因此这样考虑旁路元件的方法是合理的。
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1、起初的2ns是一个短的尖峰。产生这个尖峰是由于引脚电感的作用。我们可以用尖峰下的面积来估算引脚电感。
其中：rs=测试夹具的源端阻抗，ω
a=尖峰下的面积v-s
△v=测试夹具的开路阶跃电压，v
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x=尖峰后测量的阶跃电压，v
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