Video Processing subsystem例程分析
1.memory_ss模块
slave端口：
s00：
连接设备： microblaze_ss----m_axi_dc
时钟来源： s01_aclk---clk_out2(clock_and_reset)---100mhz
复位来源： s01_aresetn---peripheral_aresetn(clock_and_reset)
s01：
连接设备：microblaze_ss---m_axi_ic
时钟来源：s01_aclk---clk_out2(clock_and_reset)---100mhz
复位来源：s01_aresetn---peripheral_aresetn(clock_and_reset)
s02：
连接设备：v_proc_ss_0---m_axi_mm(接收video_processing_subsystem master端口传过来的 数据)
时钟来源：mig_7series_0---ui_clk/aclk
复位来源：m00_aresetn
master端口：
m00：
连接设备：mig_7series_0---s_axi(将数据传递给ddr3)
时钟来源：mig_7series_0---ui_clk/aclk
复位来源：m00_aresetn
s02，m00公用时钟和复位原因是，对同一个数据流进行操作，接收数据与发送数据。
2.microblaze_ss模块
slave端口：
s00_axi:
连接设备： microblaze----m_axi_dp
时钟来源： lmb_clk---clk_out2(clock_and_reset)---100mhz
复位来源： s00_aresetn---peripheral_aresetn(clock_and_reset)
master端口：
m00_axi:
连接设备： video_lock_monitor(axi gpio)---s_axi
时钟来源： m00_aclk---clk_out3(clock_and_reset)---9mhz
复位来源： m00_aresetn---peripheral_aresetn_2(clock_and_reset)
m01_axi:
连接设备： v_proc_ss_0(video processing subsystem)---s_axi_ctrl
时钟来源： lmb_clk---clk_out2(clock_and_reset)---100mhz
复位来源： s00_aresetn---peripheral_aresetn(clock_and_reset)
m02_axi:
连接设备： v_tc_0(video timing controller)---ctrl
时钟来源： lmb_clk---clk_out2(clock_and_reset)---100mhz
复位来源： s00_aresetn---peripheral_aresetn(clock_and_reset)
m03_axi:
连接设备： axi_uartlite_0(axi uartlite)---s_axi
时钟来源： lmb_clk---clk_out2(clock_and_reset)---100mhz
复位来源： s00_aresetn---peripheral_aresetn(clock_and_reset)
m04_axi:
连接设备： v_tpg_0(video test pattern generator)---s_axi_ctrl
时钟来源： m04_aclk---clk_out1(clock_and_reset)---200mhz
复位来源： m04_aresetn---peripheral_aresetn_1(clock_and_reset)
关于m_axi_dc，m_axi_ic端口描述：
microblaze core block diagram
什么是instruction-sdie bus interface, data-side bus interface:
3.clock_and_reset模块
clk_wiz_0:
clk_in1---clk_in1---aclk(memory_ss)
clk_out1---200mhz (reset is peripheral_aresetn_1)
clk_out2---100mhz(reset is peripheral_aresetn)
clk_out3---9mhz(reset is peripheral_aresetn_2)
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slave端口：
s00：
连接设备： microblaze_ss----m_axi_dc
时钟来源： s01_aclk---clk_out2(clock_and_reset)---100mhz
复位来源： s01_aresetn---peripheral_aresetn(clock_and_reset)
s01：
连接设备：microblaze_ss---m_axi_ic
时钟来源：s01_aclk---clk_out2(clock_and_reset)---100mhz
复位来源：s01_aresetn---peripheral_aresetn(clock_and_reset)
s02：
连接设备：v_proc_ss_0---m_axi_mm(接收video_processing_subsystem master端口传过来的 数据)
时钟来源：mig_7series_0---ui_clk/aclk
复位来源：m00_aresetn
master端口：
m00：
连接设备：mig_7series_0---s_axi(将数据传递给ddr3)
时钟来源：mig_7series_0---ui_clk/aclk
复位来源：m00_aresetn
s02，m00公用时钟和复位原因是，对同一个数据流进行操作，接收数据与发送数据。
2.microblaze_ss模块
slave端口：
s00_axi:
连接设备： microblaze----m_axi_dp
时钟来源： lmb_clk---clk_out2(clock_and_reset)---100mhz
复位来源： s00_aresetn---peripheral_aresetn(clock_and_reset)
master端口：
m00_axi:
连接设备： video_lock_monitor(axi gpio)---s_axi
时钟来源： m00_aclk---clk_out3(clock_and_reset)---9mhz
复位来源： m00_aresetn---peripheral_aresetn_2(clock_and_reset)
m01_axi:
连接设备： v_proc_ss_0(video processing subsystem)---s_axi_ctrl
时钟来源： lmb_clk---clk_out2(clock_and_reset)---100mhz
复位来源： s00_aresetn---peripheral_aresetn(clock_and_reset)
m02_axi:
连接设备： v_tc_0(video timing controller)---ctrl
时钟来源： lmb_clk---clk_out2(clock_and_reset)---100mhz
复位来源： s00_aresetn---peripheral_aresetn(clock_and_reset)
m03_axi:
连接设备： axi_uartlite_0(axi uartlite)---s_axi
时钟来源： lmb_clk---clk_out2(clock_and_reset)---100mhz
复位来源： s00_aresetn---peripheral_aresetn(clock_and_reset)
m04_axi:
连接设备： v_tpg_0(video test pattern generator)---s_axi_ctrl
时钟来源： m04_aclk---clk_out1(clock_and_reset)---200mhz
复位来源： m04_aresetn---peripheral_aresetn_1(clock_and_reset)
关于m_axi_dc，m_axi_ic端口描述：
microblaze core block diagram
什么是instruction-sdie bus interface, data-side bus interface:
3.clock_and_reset模块
clk_wiz_0:
clk_in1---clk_in1---aclk(memory_ss)
clk_out1---200mhz (reset is peripheral_aresetn_1)
clk_out2---100mhz(reset is peripheral_aresetn)
clk_out3---9mhz(reset is peripheral_aresetn_2)
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