数字电子技术之逻辑门电路的讲解
数字电路设计中逻辑门是最基本的运算单元，其中与门、或门和非门是最基本的逻辑门单元，但实际设计中用到的逻辑往往比与、或、非复杂得多，不过它们都可以利用与、或、非门组合实现。比如与非门、或非门、异或门和同或门等等。这些逻辑门的图形符号如下图：
如何利用门单元搭建电路？
利用门单元搭建的电路称为门电路，按照一定的逻辑关系使不同的门单元连接起来实现我们所需要的逻辑功能，这就是数字电路设计的目的。下面给大家介绍两个利用逻辑门单元搭建一位半加器和一位全加器门电路的例子：
上图是由一个与门和一个异或门搭建的半加器电路，其中a和b是半加器的输入信号，s是半加器的结果输出，c是半加器的进位输出。
上图是由逻辑门单元搭建出来的一位全加器电路，a、b是全加器的输入端信号，ci是全加器的进位输入信号，s是全加器结果输出，co是全加器的进位输出。
为什么可以实现加法功能？下面简单分析一下上面两个门电路实现加法功能的原理，首先解释一下半加器和全加器的区别：半加器是只对输入信号a、b进行相加，不考虑进位；而全加器除了考虑a、b相加外还加上进位ci。
其中，半加器相加，只有当a和b同时为1时，相加才会产生进位，因此co=a&b。当a和b同时为0时，相加结果s=0。只有a和b其中一个为0另一个为1时，相加结果s=1，因此s=a^b。
全加器的运算复杂一点，当a、b、ci三个输入其中有1个或者3个都为1时，相加结果s=1，否则s=0，因此s=a^b^ci；当a、b、ci三个输入中任意两个或者三个都为1时，相加就会产生进位co=1，否则co=0，因此co=a&b|a&c|b&c。
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其中，半加器相加，只有当a和b同时为1时，相加才会产生进位，因此co=a&b。当a和b同时为0时，相加结果s=0。只有a和b其中一个为0另一个为1时，相加结果s=1，因此s=a^b。
全加器的运算复杂一点，当a、b、ci三个输入其中有1个或者3个都为1时，相加结果s=1，否则s=0，因此s=a^b^ci；当a、b、ci三个输入中任意两个或者三个都为1时，相加就会产生进位co=1，否则co=0，因此co=a&b|a&c|b&c。
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