前记:看到了很多介绍ic或者fpga设计工具系统的资料,但是感觉都不是很综合。所以这里尝试做一个2012版的eda工具介绍。
fpga设计
基本设计工具,quartus, ise, synplify pro, modelsim.
主流fpga器件主要是两家,altera和xilinx。所以两家的quartus和ise是fpga设计流程中的基础。
当然synplify pro也对各自有支持。
modelsim既有oem版,也有se版,行行种种,作为ise设计流程中的无缝环节,用modelsim se是个不错的选择。
ic 设计工具
基本设计工具:verdi,dc,pt,fm,soc encounter,还有calibre。
世界三大eda厂商一般指的是cadence, synopsys, mentor graphics,四强的话好包括springsoft。就我个人的理解,synopsys主要是强在前端,dc和pt是公认的标准。cadence牛在后端,无论是rf, 数字,亦或是pcb级,它的后端布线工具都用的挺广的。mg的工具则有点分散,物理验证和参数提取的calibre也是大多数公司采用的sign off 工具,而modelsim也用的是相当广泛,最近catapultc的systemc综合工具也涌现出来和synopsys的synphony c compiler来抗衡。个人的理解,mg工具的流行主要是在其平台友好性,几乎所有的工具都可以在windows上运行,而这一点是前两家难以做到的。springsoft最突出的工具可能就是从debussy过渡来的verdi(现在已经是verdi3了),主要是用来做代码查错。
代码查错的工具:synopsys的leda(最简单), springsoft的nlint,spygalss(最全面,可以做cdc)
仿真:synopsys vcs,cadence nc-verilog, verilog-xl,以及mg的modelsim和questasim(两者间命令上没有太大的差别,但是后者主要是针对各大验证方法学来的,对systemverilog支持更好)
综合:s的dc,cadence的buildgates。
时序:s的pt,cadence的pearl
layout工具:cadence的virtuoso,springsoft的laker
p&r:s的icc,astro,cadence的soc encounter(现在改为edi)
drc, lvs,参数提取 : s的herclues,starrc(herclues做物理验证,starrc做参数提取),cadence diva/dracula/assura(assura需要单独装)以及mg的calibre
spice工具:s的hspice以及cadecen的spectre
--update(0810):
synopsys 的设计部分是galaxy design system, 验证部分是discovery platform.
从前到后的全流程设计,vcs, dc, dftc, formality, prtimetime, tetramax(atpg)
后端的是,hercules(drc, lvs), icc(including design planning), 参数提取star-rcxt.
sign off, sta是primetime, si是pt-si, transistor仿真是hsim(nanosim, 都是fastspice家族的,不同于hspice和spectre,不清楚具体区别),power是primerail(astro-rail来的)
cadence的全流程很多工具都没有接触到(ref_link)
通过link中的右边栏的相关产品,可以发现encounter家族还是有很多和synopsys的对应产品,只不过,都是encounter的名字,常说的apr工具其实是encounter design implementation(edi) system。这才是比较专业的叫法。
mentor
前面关于mentor的讲法不是很准确,固然和win有很强的相关性,但发现mentor的产品很多走的是验证路线。无论是功能仿真,还是pcb级或物理验证,都是验证的路线。物理验证当然是calibre, mbistarchitect 也是业内用于做mbist做多的产品。
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