AD9250参数配置的程序（AD9250 参数配置 + Xilinx Kintex
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设计简介
本次的demo设计将通过上位机的设置界面，完成ad9250的参数设置。界面通过usb2.0控制器cy68013完成数据ad9250的配置工作。
ad9250的参数配置是通过spi的接口完成，spi的接口由3个io组成：
the serial clock pin sclk：
n sclk的为时钟io，其最高的工作频率为25mhz，并接50k的下拉电阻。
the serial data input/output pin sdio。
n sdio为数据传输的双向io口，在ad9250中，sdio的初始状态为输入io，在获取读写命令后，io的输入输出方向将会发生相应的变化。
the chip select bar pin csb。
n 片选信号，低电平有效。
根据ad9250的配置参数的特性，配置的参数可以分为4个部分：
configurationregister
transfer register
program register
jesd204b link setup parameter
2 spi接口时序
spi的时序如图所示，数据在csb拉低时有效，并在slck的第一个上升沿开始spi的数据传输。
数据在sclk的下降沿进行更新，在sclk的上升沿进行数据的读取。
数据的具体格式为：
数据帧的第1bit的为读写控制信号，read为1，wirte为0.
数据帧的第2bit和第3bit为地址信号
n w1w0 = 11：数据帧的长度不限，在csb为低时将一直传输数据
n w1w0 = 10：数字帧的数据长度为3
n w1w0 = 01：数字帧的数据长度为2
n w1w0 = 00：数字帧的数据长度为1
数据帧的第4-16bit：访问ad的内存地址。有效空间为0-255。
后续为写入或者读出的ad的控制数据。
3 参数配置
参数可以根据其功能的不同，分为4个部分进行介绍：
configuration register
n global spi config：lsb first 、soft reset
transfer register
n transfer settings：该位置1表示将
program register
n
jesd204b link setup parameter
1. disable lanes before changingconfiguration
2. select quick configurationoption
3. configure detailed options
4. check fchk, checksum ofjesd204b interface parameters
5. set additional digital outputconfiguration options
6. re-enable lane(s)
4 配置流程
//配置ad9250的寄存器的工作方式
write(5f, 15); //204b link control,powerdown jesd204b link,ilas test mode
write(0b,01); //选择时钟的分频系数
write(ff,01); //将写入的控制数据统一更新，该功能可以让输入的控制数据在向0xff写1后统一获得更新。
write(5e, 0x22); //selectquick configuration option
write(ff,01); //将写入的控制数据统一更新，该功能可以让输入的控制数据在向0xff写1后统一获得更新。
write(0x6e, 0x01); // disabled scrambling
write(5f, 14); //204b link control,power onjesd204b link,
ad参数配置：5
1、 sof_reset（0x00）：复位所有的寄存器（）
2、 pdwn（0x08）：关掉jesd204b
3、 global clock（0x09）：（默认）
4、 global clock divide（0x0b）：（）
5、 adc vref （0x18）：
6、 pll low enable（0x21）：
jesd链路配置：
1、204b link ctrl1 （0x5f）
2、204b quick config （0x5e）
3、cml output adjust （0x15）
4、pdwn modes （0x08） ：待机时jesd的电源工作模式
5、204b parameters subclass/np （0x73）
6、204b link ctrl 1 (测试采样使能)
7、syncinb±/ sysref± ctrl （0x3a）
5 kintex-7的gtx的配置注意事项
k码 在配置gtx时需要配置两个k码 k28.5和k28.7 这两个k码译码后仅有一bit的数据不同，所以在设置时可以设置k28.5作为k码，同时mask其中的第二bit的数据。
第二个问题：数据收到后，在数据解析时，应该注意的是其数据格式的分布 ：
采样数据的高位被先发送出来，所以数据采样后应该做一个调换。
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the serial clock pin sclk：
n sclk的为时钟io，其最高的工作频率为25mhz，并接50k的下拉电阻。
the serial data input/output pin sdio。
n sdio为数据传输的双向io口，在ad9250中，sdio的初始状态为输入io，在获取读写命令后，io的输入输出方向将会发生相应的变化。
the chip select bar pin csb。
n 片选信号，低电平有效。
根据ad9250的配置参数的特性，配置的参数可以分为4个部分：
configurationregister
transfer register
program register
jesd204b link setup parameter
2 spi接口时序
spi的时序如图所示，数据在csb拉低时有效，并在slck的第一个上升沿开始spi的数据传输。
数据在sclk的下降沿进行更新，在sclk的上升沿进行数据的读取。
数据的具体格式为：
数据帧的第1bit的为读写控制信号，read为1，wirte为0.
数据帧的第2bit和第3bit为地址信号
n w1w0 = 11：数据帧的长度不限，在csb为低时将一直传输数据
n w1w0 = 10：数字帧的数据长度为3
n w1w0 = 01：数字帧的数据长度为2
n w1w0 = 00：数字帧的数据长度为1
数据帧的第4-16bit：访问ad的内存地址。有效空间为0-255。
后续为写入或者读出的ad的控制数据。
3 参数配置
参数可以根据其功能的不同，分为4个部分进行介绍：
configuration register
n global spi config：lsb first 、soft reset
transfer register
n transfer settings：该位置1表示将
program register
n
jesd204b link setup parameter
1. disable lanes before changingconfiguration
2. select quick configurationoption
3. configure detailed options
4. check fchk, checksum ofjesd204b interface parameters
5. set additional digital outputconfiguration options
6. re-enable lane(s)
4 配置流程
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write(0b,01); //选择时钟的分频系数
write(ff,01); //将写入的控制数据统一更新，该功能可以让输入的控制数据在向0xff写1后统一获得更新。
write(5e, 0x22); //selectquick configuration option
write(ff,01); //将写入的控制数据统一更新，该功能可以让输入的控制数据在向0xff写1后统一获得更新。
write(0x6e, 0x01); // disabled scrambling
write(5f, 14); //204b link control,power onjesd204b link,
ad参数配置：5
1、 sof_reset（0x00）：复位所有的寄存器（）
2、 pdwn（0x08）：关掉jesd204b
3、 global clock（0x09）：（默认）
4、 global clock divide（0x0b）：（）
5、 adc vref （0x18）：
6、 pll low enable（0x21）：
jesd链路配置：
1、204b link ctrl1 （0x5f）
2、204b quick config （0x5e）
3、cml output adjust （0x15）
4、pdwn modes （0x08） ：待机时jesd的电源工作模式
5、204b parameters subclass/np （0x73）
6、204b link ctrl 1 (测试采样使能)
7、syncinb±/ sysref± ctrl （0x3a）
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