ADC中采样开关引起的误差的两种因素分析
在adc中，采样开关引起的误差主要由两个因素导致，分别是电荷注入和导通电阻非线性。前者主要由mos管导通时导电沟道电荷的产生和消失引起。当一个mos管工作在三极管区时，沟道电荷的大小为：
当开关关断的时候，沟道电荷需要消失，电荷只能流入到mos管本身的s端或d端，对两端的电压造成影响。因此流入采样电容上的电荷会产生一个offset，offset的大小取决于多个因素，如：工艺、晶体管尺寸、输入电压和开关时序等。最重要的是offset和输入相关，这会在采样时导致产生谐波。
导通电阻非线性主要由开关导通电阻与输入信号的相关性引起。下图为导通电阻的大小：
可以看到，无论哪种因素，当vs=vin时，过驱动电压vgs都是输入电压的函数。
下图所示为栅压自举电路，该电路理论上可以摆脱vgs对输入信号的依赖，使vgs成为一个恒定值，提升导通电阻线性度，降低谐波。
图1 栅压自举电路
在clk=0时，电容器cb被m1和m2预充电到v dd。m3和m4紧接地输出时钟clk out，关闭m8和m10，而m5关闭m7。
当clk=1时，m6打开m7， m7打开m8，m8和m9在cb的底板处分别得到vin。这使得cb的上板变成v dd + vin并由m7向clk out提供这个值。实际上，这个值会被寄生电容c p衰减。该寄生电容主要是m2和m7的体寄生电容和版图的走线寄生构成。因此，在自举电路的有效性和电路可达到的最大采样速度之间存有一个折中关系。
m4 的作用是在clk=1阶段降低了对m3施加的vds和vgs，确保不会有超压风险。m4和m3一般需要足够大，使之不会在采样时钟的下降沿引入过多的抖动噪声。而m10确保整个采样阶段m7的持续导通。
注意：图1中的m9并不是必须的。它是一个虚拟开关，以平衡在clkout看到的负载，并确保对称性（和后级电路相关）。
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