(文章来源:电子工程世界)
配电网络(pdn)是所有电源系统的主干部分。随着系统电源需求的不断上升,传统pdn承受着提供足够性能的巨大压力。对于功耗和热管理而言,主要有两种方法可以改善pdn对电源系统性能的影响。一是使用更大线缆、连接器和更厚主板电源层减少pdn电阻;二是在给定的传输功率下,提高pdn电压以减小电流,这允许使用更小的线缆、连接器和更薄的主板铜箔电源层,从而可缩减相应的尺寸、成本和重量。
多年来,工程师一直使用第一种方法,因为该方法与数十年来为单相ac及12v dc-dc转换器及稳压器构建的大型生态系统兼容。其它原因还包括dc-dc转换器拓扑性能不足,无法高效将更高电压直接转换为负载点(pol)电压,以及这些电压更高的转换器及稳压器的相关费用等。
然而,现代电源设计使用第二种方法的越来越多,提高pdn电压。这一趋势的推动力源于系统负载功率的显著提升。以数据中心为例,人工智能(ai)、机器学习和深度学习的加入,使机架功率迅速上升到了两倍,达到20kw范围,而超级计算机服务器机架则已接近100kw或更高。理想的负载点电源系统。稳压器在vin= vout时提供最高效率。大电流供电最接近负载点时效率最高,从而可最大限度降低i2r损耗。
这一电源需求的增长促使系统工程师对其整个pdn进行了重新评估,从机架到机架内部的配电,乃至服务器刀片上的pdn,无一例外,因为现代cpu和ai处理器功耗更大。机架功率为5kw水平时,单相ac到机架是正常的。然后将ac转换为12v,配送给服务器刀片。功率为5kw时,pdn电流为416a (5kw/12v),配电通过大量线缆进行。
处理器功率大约从2015年开始急剧上升,因此机架电源上升到了12kw。所以,必须在12v pdn的机架内对1ka电流进行管理。ocp (开放计算项目)联盟成员主要包括云计算、服务器和cpu公司,该联盟将一如既往地发展其12v机架设计。ocp机架从线缆转移到了母线排,并在机架内分配多个单相ac至12v转换器,以最大限度缩减机架到服务器刀片的pdn距离以及阻抗。与以往机架供电的主要差异是,以前来自于机架馈电的单相交流电为三相中的单相。
能够构建其自己的机架及数据中心解决方案的公司开始转而采用48v配电。这一策略将12kw机架的大电流pdn问题削减到了250a,但为刀片服务器的功率转换带来了新的难题。通过“最后一英寸”传输大电流,为高功率处理器设置了障碍。vicor技术不仅可提高这一性能,而且还可简化主板设计。
机架电源超过20kw的范围时,服务器机架pdn设计将不断发展。人们为了维持12v原有系统的现状,在许多方面都得有创新,但数据中心引入ai的处理器稳态电流超过1000安培、峰值电流接近2000安培时,就会让基于12v传统的pdn不切实际。ai的核心是性能,而12v pdn则会限制性能和竞争力。
为了解决高功率机架的诸多难题,ocp联盟正在向可容纳48v pdn的机架发展。从12v配电转向48v,可将输入电流需求降低4倍(p=v×i),将损耗锐减16倍(功耗= i2r)。此外,汽车、5g、led照明和显示屏市场以及工业应用,也在向48v配电转型。因此,48v电源转换器生态系统正在迅猛发展,转用48v有很好的商业意义。但不是所有的48v转换器拓扑及架构都相同。48v转换器市场性能参差不齐,这是一个值得仔细考虑的实际情况。
由于高性能和电源效率位列高功率机架及数据中心需求的榜首,有几家公司正在采用三相ac至48v,为服务器刀片配电。另外,也可使用机架内分配的高电压dc(380v,源自整流三相输入)。多家高性能计算公司正在将hvdc pdn用于功率高达100kw的机架。为服务器刀片供电的pdn转换为48v时,刀片上的电源转换也必须改变。这种转变导致了dc-dc转换器与稳压器在架构、拓扑与封装的多种选择。
48v模式对于数据中心服务器而言还很陌生,但在路由器和网络交换机等通信应用中却很普及,因为它们使用的是可充电的48v铅酸备用电池系统。数据中心服务器中以前使用的通用架构叫中间母线架构或iba。iba包括隔离式非稳压母线转换器,可将-48v转换为+12v,提供给一系列多相降压稳压器,用于负载点。一些云计算公司和hpc公司最初为其48v系统复制了这一架构,但在功率增加而pol电压降至1v以下时,设计人员开始寻找可替代的架构和拓扑。
电源系统架构、开关拓扑和封装对于高性能高密度设计而言非常重要。随着ai及cpu处理器电流的增加,由于稳压器和pol之间的pdn电阻影响,pol处功率传递电路的密度成为人工智能应用中最关键的元素。业界一流的最新ai处理器具有大约1ka的稳态电流,峰值电流达1.5ka至2ka。考虑到处理器常规多相降压稳压器输出的典型pdn电阻在200至400?ω之间,所带来的pcb功耗为稳态(p = i2r) 200-400w,对于任何系统来说,都太高了,根本无法处理。
pdn损耗成了dc-dc稳压器设计效率及性能的主导因素。这是一个负载点问题,而且提高电压根本不现实(pol电压在快速下降,以维持摩尔定律的有效性),因此唯一可行的方法是减少pdn电阻,将稳压器尽量靠近处理器布置。在多相降压稳压器的案例中,通常会占用16-24个相位,才能支持ai处理器的大电流。这不是一种高电流密度方案,无法解决pdn功耗问题。
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