RX72M和PHY芯片连接时的注意事项
瑞萨电子的mcu产品rx72m是一款适用于工业网络解决方案的高性能32位微控制器，在应用时需搭配外部的以太网phy芯片。本次我们介绍rx72m和phy芯片连接时的注意事项。
一
所需引脚定义
首先，rx72m和phy芯片整体的连接关系如下图（rx72m hardware manual中example of connection with the phy-lsi）所示：
图1 rx72m和phy-lsi连接示例
由于rx72m具备两个esc端口，因此需要连接两颗phy芯片。
对于每个phy芯片，和rx72m连接时用到的引脚如下：
图2 每个phy芯片和rx72m引脚的连接
注：*的值为0或1。
两个phy芯片共同连接到rx72m的引脚如下：
图3 两个phy芯片和rx72m连接时共用的引脚
注：mdio引脚需增加4.7k上拉电阻。
二
phy接口模式选择
每个phy芯片的power on strapping要求不尽相同，由于rx72m esc仅支持mii模式，因此引脚配置请参考mii对应的要求（下表中黄色高亮的部分）：
图4 phy芯片 power on strapping - mode config
三
phy地址配置
对于mcu和phy芯片通信来说，phy芯片地址是非常重要的参数。由于rx72m具备两个esc端口，因此需要通过地址对两颗phy芯片进行区分。此情况下，00b地址不可用。请从下表中的3种可选项中选取任意两个。
图5 phy芯片 power on strapping – phy address
由于需要利用两颗led分别指示phy芯片的link和activity状态，因此将pin 10 rxd1设定为led mode，如下图所示：
图6 phy芯片 power on strapping – wake on lan selection
四
系统设计流程
有了前面的基础信息，我们可以按照以下的步骤进行系统设计。
01
选取板上两颗phy芯片的phy address，由此决定led/phyadd0和led1/phyadd1的初始电平。
02
依据phy address决定led的有效驱动电平，设计rj45接口电路。下图是rj45的参考设计，保留了充分的冗余设计，可适配不同phy address选项。
图7 rj45部分参考设计
03
以led0（green）表示link status，led1（yellow）表示activity status为例，不同的phy address选项下，对应了不同的电阻配置，参考下表中的说明调整rj45中电阻的焊接/不焊接配置。
图8 phy address和电阻设定对照表
04
对照硬件设计，需要在rx72m project的smart configurator中进行phy address和link signal polarity设定，下图以phy address分别为2和3时的设定值。注意，phy address的低位（bit 0）决定了link signal active level。具体地说，如果bit 0为0，则表示上电时该引脚电平已为低，则phy芯片link起来时，该引脚电平会变高，因此link signal active level应设定为active-high。bit 0为1时则刚好相反。
图9 phy address和link signal polarity设定方式
五
软件引脚初始化
最后，需要在rx72m代码（r_ecat_setting_rx72m.c中函数esc_init()）中增加对phy芯片初始化的配置，使得phy芯片按照设定的模式工作。
左右滑动查看完整内容
//configuration for phy0write_phyreg((ecat_cfg_ch0_phy_address - ecat_cfg_phy_offset_address), 0x1e, 0x40c0); // ext 40c0write_phyreg((ecat_cfg_ch0_phy_address - ecat_cfg_phy_offset_address), 0x1f, 0x0030);write_phyreg((ecat_cfg_ch0_phy_address - ecat_cfg_phy_offset_address), 0x1e, 0x40c0);write_phyreg((ecat_cfg_ch0_phy_address - ecat_cfg_phy_offset_address), 0x1e, 0x40c3); // ext 40c3write_phyreg((ecat_cfg_ch0_phy_address - ecat_cfg_phy_offset_address), 0x1f, 0x0320);write_phyreg((ecat_cfg_ch0_phy_address - ecat_cfg_phy_offset_address), 0x1e, 0x40c3);//configuration for phy1write_phyreg((ecat_cfg_ch1_phy_address - ecat_cfg_phy_offset_address), 0x1e, 0x40c0); // ext 40c0write_phyreg((ecat_cfg_ch1_phy_address - ecat_cfg_phy_offset_address), 0x1f, 0x0030);write_phyreg((ecat_cfg_ch1_phy_address - ecat_cfg_phy_offset_address), 0x1e, 0x40c0);write_phyreg((ecat_cfg_ch1_phy_address - ecat_cfg_phy_offset_address), 0x1e, 0x40c3); // ext 40c3write_phyreg((ecat_cfg_ch1_phy_address - ecat_cfg_phy_offset_address), 0x1f, 0x0320);write_phyreg((ecat_cfg_ch1_phy_address - ecat_cfg_phy_offset_address), 0x1e, 0x40c3);
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RX72M和PHY芯片连接时的注意事项
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FPGA设计中Tcl在Vivado中的基础应用
如何避免步进电机的失步？浅谈防止如何步进电机失步的方法
“中台”热反映了IT架构和组织模式的新变革
Google的翻译功能将不再仅限于智能手机
lora无线模块E30-M系列与E32-M系列新品的优势
【技术解析】再说CeraLink®
4-20mA隔离调理器(用有源信号调控有源负载)
基于UC3637的直流电动机PWM控制电路图
一
所需引脚定义
首先，rx72m和phy芯片整体的连接关系如下图（rx72m hardware manual中example of connection with the phy-lsi）所示：
图1 rx72m和phy-lsi连接示例
由于rx72m具备两个esc端口，因此需要连接两颗phy芯片。
对于每个phy芯片，和rx72m连接时用到的引脚如下：
图2 每个phy芯片和rx72m引脚的连接
注：*的值为0或1。
两个phy芯片共同连接到rx72m的引脚如下：
图3 两个phy芯片和rx72m连接时共用的引脚
注：mdio引脚需增加4.7k上拉电阻。
二
phy接口模式选择
每个phy芯片的power on strapping要求不尽相同，由于rx72m esc仅支持mii模式，因此引脚配置请参考mii对应的要求（下表中黄色高亮的部分）：
图4 phy芯片 power on strapping - mode config
三
phy地址配置
对于mcu和phy芯片通信来说，phy芯片地址是非常重要的参数。由于rx72m具备两个esc端口，因此需要通过地址对两颗phy芯片进行区分。此情况下，00b地址不可用。请从下表中的3种可选项中选取任意两个。
图5 phy芯片 power on strapping – phy address
由于需要利用两颗led分别指示phy芯片的link和activity状态，因此将pin 10 rxd1设定为led mode，如下图所示：
图6 phy芯片 power on strapping – wake on lan selection
四
系统设计流程
有了前面的基础信息，我们可以按照以下的步骤进行系统设计。
01
选取板上两颗phy芯片的phy address，由此决定led/phyadd0和led1/phyadd1的初始电平。
02
依据phy address决定led的有效驱动电平，设计rj45接口电路。下图是rj45的参考设计，保留了充分的冗余设计，可适配不同phy address选项。
图7 rj45部分参考设计
03
以led0（green）表示link status，led1（yellow）表示activity status为例，不同的phy address选项下，对应了不同的电阻配置，参考下表中的说明调整rj45中电阻的焊接/不焊接配置。
图8 phy address和电阻设定对照表
04
对照硬件设计，需要在rx72m project的smart configurator中进行phy address和link signal polarity设定，下图以phy address分别为2和3时的设定值。注意，phy address的低位（bit 0）决定了link signal active level。具体地说，如果bit 0为0，则表示上电时该引脚电平已为低，则phy芯片link起来时，该引脚电平会变高，因此link signal active level应设定为active-high。bit 0为1时则刚好相反。
图9 phy address和link signal polarity设定方式
五
软件引脚初始化
最后，需要在rx72m代码（r_ecat_setting_rx72m.c中函数esc_init()）中增加对phy芯片初始化的配置，使得phy芯片按照设定的模式工作。
左右滑动查看完整内容
//configuration for phy0write_phyreg((ecat_cfg_ch0_phy_address - ecat_cfg_phy_offset_address), 0x1e, 0x40c0); // ext 40c0write_phyreg((ecat_cfg_ch0_phy_address - ecat_cfg_phy_offset_address), 0x1f, 0x0030);write_phyreg((ecat_cfg_ch0_phy_address - ecat_cfg_phy_offset_address), 0x1e, 0x40c0);write_phyreg((ecat_cfg_ch0_phy_address - ecat_cfg_phy_offset_address), 0x1e, 0x40c3); // ext 40c3write_phyreg((ecat_cfg_ch0_phy_address - ecat_cfg_phy_offset_address), 0x1f, 0x0320);write_phyreg((ecat_cfg_ch0_phy_address - ecat_cfg_phy_offset_address), 0x1e, 0x40c3);//configuration for phy1write_phyreg((ecat_cfg_ch1_phy_address - ecat_cfg_phy_offset_address), 0x1e, 0x40c0); // ext 40c0write_phyreg((ecat_cfg_ch1_phy_address - ecat_cfg_phy_offset_address), 0x1f, 0x0030);write_phyreg((ecat_cfg_ch1_phy_address - ecat_cfg_phy_offset_address), 0x1e, 0x40c0);write_phyreg((ecat_cfg_ch1_phy_address - ecat_cfg_phy_offset_address), 0x1e, 0x40c3); // ext 40c3write_phyreg((ecat_cfg_ch1_phy_address - ecat_cfg_phy_offset_address), 0x1f, 0x0320);write_phyreg((ecat_cfg_ch1_phy_address - ecat_cfg_phy_offset_address), 0x1e, 0x40c3);
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基于UC3637的直流电动机PWM控制电路图