基于安路PCIe SGDMA 高速数据传输方案
安路科技ph1a系列fpga定位高性价比逻辑器件，针对高带宽应用场景，能够在保持低功耗的前提下，提供同类最佳的收发器和信号处理功能。
ph1a系列fpga集成的第三代pcie硬核控制器，带宽最高可达8gbit/s、可通过td软件的ip gen配置。该核架构广泛应用于通信设备、网络接口卡、存储系统等领域，具有高性能、低成本等特点。
pcie sgdma演示方案
安路科技提供基于pcie 硬核控制器开发的sgdma ip。sgdma可作为一个pcie2axi4系列接口的桥或者一个高性能dma使用。
sgdma支持属性
64bit和128bit(ph1a90、ph1a180)数据位宽
32bit或64bit源地址、目的地址和描述符地址
目前支持单通道c2h以及单通道h2c
后续版本将支持n通道c2h以及n通道h2c
可选的单通道axi4-stream接口或axi4-mm（memory mapped）接口
支持axi4-lite master读写用户和dma寄存器
支持axi4-lite slave读dma状态寄存器
支持scatter gather描述符列表和环形描述符列表，列表大小无限制
msi-x中断 （后续支持）
bypass descriptor 通道 （后续支持）
图1.dma框图
sgdma工作流程
sgdma工作分为两个流程，h2c(host to card)和c2h(card to host)。
dma c2h 方向传输摘要：
图2.c2h传输框图
首先，应用程序启动c2h传输，并设置传输长度和用于存储数据的缓冲器位置。然后，驱动程序会基于传输长度创建描述符，并将信息写入寄存器控制传输启动。dma开始启动描述符提取请求，之后dma接收到描述符，判断是否为最后一个描述符，如果是则停止，否则继续发送描述符提取请求。dma会根据接收的描述符向（板卡）源地址发送读请求，读请求会持续到没有剩余描述符，并从板卡的axi4（mm或者stream）接口上接收数据，向主机发送数据，数据发送完毕以后向主机发送中断。
驱动程序将执行中断流程，并读取完成描述符计数寄存器，与生成的描述符数量对比。随后将控制权随传输大小一起返还给应用程序。应用程序从分配的缓冲器读取传输数据，并将其写入文件。文件写入完成后，退出应用程序。
h2c的流程与c2h的类似，主要的不同点为c2h将板卡的数据发送给主机，h2c接收主机的数据。
图3.h2c传输框图
上海安路科技于2020年12月底正式成为pci-sig协会新会员。加入pci-sig协会后，安路科技将获得更为广泛的服务、了解最新的pci技术动态，同时能参与pci技术法规研讨会、参与规范修订和补充建议、pci技术支持、获得vendor id分配等系列服务与支持，这些都将助力安路研发技术和技术创新的稳步提升与发展。
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什么是pcie？
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原文标题：基于安路pcie sgdma 高速数据传输方案
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图3.h2c传输框图
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