Xilinx FPGA IP之Block Memory Generator功能概述
xilinx block memory generator(bmg)是一个先进的内存构造器，它使用xilinx fpga中的嵌入式块ram资源生成面积和 性能优化的内存。
支持普通接口和axi两种接口。bmg ip的axi4接口配置派生自本地接口 配置，在ip中添加了一个行业标准总线协议接口。有两种可用的axi4 接口样式:axi4和 axi4- lite。
功能概述：
•优化算法最小块ram资源利用率或低功耗利用率
•可配置内存初始化
•在ultrascale™，ultrascale+™，zynq®-7000，
spartan®-7,artix®-7,kintex®-7和virtex®-7器件上独立的byte写使能(带或不带奇偶校验)
•优化的verilog行为模型用于仿真提速;精确的结构仿真模型用于模拟存储行为
•每个端口可选择的操作模式:write_first, read_first或no_change
•sdp模式下有更低的数据宽度
•标准dout块ram级联
使用普通接口时：
•生成单端口ram，简单双端口ram，真双端口ram，单端口
rom和双口rom
•支持最大16m bytes的内存大小(字节大小8或9)(仅受选定部分的内存资源限制)
•可配置端口输入输出比
•支持内置ecc (hamming error correction capability)。错误注入引脚允许插入单位和双位错误
•支持数据宽度小于64位的软ecc (soft hamming error correction)
•可选择流水线dout总线，以提高特定配置的性能
•在sr (set reset)或ce的优先级之间选择输出寄存器的复位优先级
•性能高达450 mhz
使用axi4接口时：
•支持axi4和axi4- lite接口协议
•符合axi4的内存和外设从属类型
•独立的读写通道
•零延迟数据路径
•支持握手信号的寄存器输出
•incr突发大小高达256个数据传输
•wrap突发大小为2、4、8和16
•axi非对齐的突发传输
•简单的双端口ram的配置
•性能高达300mhz
•支持数据宽度高达256位和内存深度从1到1m字(仅受选定部分的内存资源限制)
•对称输入输出
•异步active-low复位
使用默认接口时，支持的工作模式：
•单端口ram
•简单的双端口ram
•真正的双端口ram
•单端口rom
•双端口rom
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