开源RISC-V Hummingbird E203仿真设计
开源risc-v hummingbird e203（蜂鸟e203）的仿真工具是开源的iverilog，这里利用vcs+verdi仿真工具进行仿真；
蜂鸟 e200 主要面向极低功耗与极小面积的场景，非常适合于替代cortex-m 系列内核应用于iot或其他低功耗场景。
e200系列处理器核使用verilog语言，采用两级流水线结构，通过一流的处理器架构设计cpu的功耗与面积均优于同级arm cortex-m核， 实现业界最高的能效比与最低的成本；
e200 系列处理器核能够运行risc-v指令 ，支持rv321/e/a/m/c/f/d 等指令子集的配置组合，支持机器模式（machine mode only）；
e200 系列处理器核提供标准的jtag调试接口以及成熟的软件调试工具；
e200 系列处理器核提供成熟的gcc编译工具链；
e200 系列处理器核配soc提供紧耦合系统 ip 模块，包括中断控制器、计时器uart，qspi，pwm等，即时能用（ready-to-use）的soc平台与ppga原型系统。
e200系列处理器soc示意图
目录：
项目目录
修改
1.修改e200_opensource-master/vsim/bin文件中的run.makefile，修改vcs，verdi仿真工具和仿真选项，如下：
2.e200_opensource-master/tb/tb_top.v增加dump波形
仿真
步骤1：编译 rtl 代码，使用如下命令：
进入到 e200_opensource 目录文件夹下面的 vsim 目录。
make install core=e203
运行该命令指明需要为e203进行编译，该命令会在vsim目录下生成一个install子文件夹，在其中放置所需的脚本，且将脚本中的关键字设置为e203。
make compile
运行该命令编译core和 soc的rtl代码
步骤2：运行默认的一个testcase（测试用例），使用如下命令：
make run_test
make run_test将执行e200_opensource/riscv-tools/riscv-tests/isa/generated目录中的一个默认testcase，如果测试用例运行通过则打印pass，并生成波形，如下图，
步骤3：打开verdi，加载波形
使用如下命令：make wave
如果希望运行所有的回归测试，请参见步骤4。
步骤4 运行回归 regression 测试集 ，使用如下命令
make regress_run core=e203
该命令使用e200_opensource/riscv-tools/riscv-tests/isa/generated目录中e203 core testcases 逐个的运行各testcase.
步骤5：查看回归测试结果
make regres_ collect core=e203
该命令将收集步骤4中运行的测试集的结果，每行对应一个测试用例，如果测试用例运行通过则打印 pass ，如果运行失败则打印 fail;
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进入到 e200_opensource 目录文件夹下面的 vsim 目录。
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make compile
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步骤3：打开verdi，加载波形
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该命令使用e200_opensource/riscv-tools/riscv-tests/isa/generated目录中e203 core testcases 逐个的运行各testcase.
步骤5：查看回归测试结果
make regres_ collect core=e203
该命令将收集步骤4中运行的测试集的结果，每行对应一个测试用例，如果测试用例运行通过则打印 pass ，如果运行失败则打印 fail;
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