DDR存储器端接电源灵活适用于2.5V和1.8V存储器系统
本设计笔记展示了 ddr 存储器端接电源如何供应和吸收 6a 电流，同时保持 1.8v 或 2.5v 电源的稳压基准电压。该电路为 ddr 同步 dram （sdram） ic 提供终止电压。具有max1637降压控制器。
工作站和服务器的高速内存包含双倍数据速率 （ddr） 同步 dram （sdram）。这些存储器ic工作在2.5v或1.8v的电源电压下，需要等于电源电压一半的基准电压（v裁判= 1/2vdd).其逻辑输出通过电阻器连接到终止电压 v电传，等于 和轨道 v裁判.即 v电传必须根据需要提供或吸收电流，同时保持 v电传= v裁判±0.04v.
图1的电路提供此v电传2.5v 和 1.8v 存储器系统的终止电压（具有 6a 拉电流/灌电流能力）。u1 是一款低压降压控制器，其最低工作电压 （3.15v） 与大多数计算机系统中的 3.3v i/o 逻辑电源兼容。u1的强制pwm工作模式可以根据需要吸收或拉出输出电流，以维持稳定的输出电压，其最大灌电流等于其最大源电流。（当灌电流时，它会将一些电流返回到输入电源。
图1.此 ddr 存储器终端电源可提供 6a 的源电流和灌电流，同时保持稳定的 1/2v 电压dd（适用于 1.8v 或 2.5v 电源）。
运算放大器 u2 与 1/2v 的比较dd（由 r5 和 r6 创建）与 v裁判从u1产生误差信号，通过r2施加到u1的反馈端子（引脚3）。该动作强制 v电传输出（本例中为0.9v）至跟踪1/2vdd.u2具有此应用所需的性能：低输入失调电压、低输入偏置电流和轨到轨输出能力。提供 1/2vdd对于内存系统，您可能需要向 r5/r6 分频器添加缓冲区。
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