Cadence推出首个TLM驱动式设计与验证解决方案提升基于
cadence推出首个tlm驱动式设计与验证解决方案提升基于rtl流程的开发效率
cadence设计系统公司推出首个tlm驱动式协同设计与验证解决方案和方法学，使soc设计师们可以尽享事务级建模（tlm）的好处。这一cadence解决方案包含集成了新式存储器编译器并支持c/c++的c-to-silicon compiler、具有最新tlm/rtl指标驱动式验证和可视化源码级调试功能的incisive enterprise simulator、calypto时序逻辑等效性检查、第一版tlm驱动式设计与验证方法学以及客户适用服务。 新解决方案可实现对基于tlm的soc ip进行设计、综合与验证，从而加快设计创建，提升功能验证效率，并提供更多机会来重复利用相关的设计和验证ip。
“我们已使用了多年的高阶综合与tlm验证，此类验证方法学已被证明是非常具有挑战性的。”富士通微电子股份有限公司图形技术中心硬件开发经理raimund soenning表示。 “cadence这一方法学可从容应对我们遇到的挑战，它从tlm到rtl使用了指标驱动式验证，并将二者混合。 使用这个全面的cadence方法学，我们发现了大量重复利用设计和验证ip的机会。” 这个新型tlm驱动式设计和验证方法学包含了面向虚拟平台和高阶综合的systemc建模准则，并定义了对tlm、tlm/rtl和rtl进行基于ovm的多语言功能验证的过程。 该方法学将通过手册、自助式教程和上机实验课程的形式提供。 新解决方案包含以下能力：从c/c++迁移从而实现传统设计源码到systemc tlm的自动转换；整合了流行存储器编译器的高阶综合技术，并针对各种架构进行了优化；以及对systemc和已综合的rtl代码进行并行式分析与追踪。 “事务级设计和验证已经成为现实，”brian bailey咨询公司的brian bailey表示。 “各个单独功能已经开发出来了，而cadence迈出了使它们在一个统一方法学中协同工作的第一步。” 新型tlm驱动式方法学提高了工作效率、设计质量和项目时间表的可预测性。 与先前技术不同，这一新型综合性解决方案使用户能够将基于tlm的设计和验证ip作为黄金源码加以重复利用。 “cadence具有得天独厚的优势对tlm/rtl设计和验证环境进行整合，以便排除用户使用的关键障碍。” cadence设计系统公司系统软件部副总裁兼总经理michael mcnamara表示， “着眼于客户的完整需求，我们正在履行提升系统级设计效率的全面承诺。”
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“我们已使用了多年的高阶综合与tlm验证，此类验证方法学已被证明是非常具有挑战性的。”富士通微电子股份有限公司图形技术中心硬件开发经理raimund soenning表示。 “cadence这一方法学可从容应对我们遇到的挑战，它从tlm到rtl使用了指标驱动式验证，并将二者混合。 使用这个全面的cadence方法学，我们发现了大量重复利用设计和验证ip的机会。” 这个新型tlm驱动式设计和验证方法学包含了面向虚拟平台和高阶综合的systemc建模准则，并定义了对tlm、tlm/rtl和rtl进行基于ovm的多语言功能验证的过程。 该方法学将通过手册、自助式教程和上机实验课程的形式提供。 新解决方案包含以下能力：从c/c++迁移从而实现传统设计源码到systemc tlm的自动转换；整合了流行存储器编译器的高阶综合技术，并针对各种架构进行了优化；以及对systemc和已综合的rtl代码进行并行式分析与追踪。 “事务级设计和验证已经成为现实，”brian bailey咨询公司的brian bailey表示。 “各个单独功能已经开发出来了，而cadence迈出了使它们在一个统一方法学中协同工作的第一步。” 新型tlm驱动式方法学提高了工作效率、设计质量和项目时间表的可预测性。 与先前技术不同，这一新型综合性解决方案使用户能够将基于tlm的设计和验证ip作为黄金源码加以重复利用。 “cadence具有得天独厚的优势对tlm/rtl设计和验证环境进行整合，以便排除用户使用的关键障碍。” cadence设计系统公司系统软件部副总裁兼总经理michael mcnamara表示， “着眼于客户的完整需求，我们正在履行提升系统级设计效率的全面承诺。”
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