dcdc电源纹波大怎么解决

网友eefishing问题: 一个dc-dc电源转换,纹波有点大,上传原理图和pcb图 用aoz1050pi设计的一款dc-dc电源转换,输入9~18v,输出1.2v,aoz1050开关频率500khz,现在用示波器测得输出大概有100mv,vp-p在485khz左右的纹波。
请问各位专家:
1 这个指标的纹波是否在设计许可的范围之内?在一般情况下,dc-dc电源转换的纹波在一个什么范围内可以认为是正常的? 2 从原理图和pcb图上,这个设计是否还能够进一步优化降低纹波?还请指出。 敬请各位斧正。
网友mituone的回复: 100mv 的纹波(ripple)对数字线路应该没什么问题,对模拟线路就看情况了,有的线路很敏感需要更低。但芯片资料展示在满载(full load)状况下,纹波(ripple)可以压到 20mv 左右。  
布线建议︰ l2 在上方,但 fb 在 aoz1050 pin 4,造成反馈路径绕了一大圈才回到芯片。将 l2 移到下方,可以缩短反馈路径。 aoz1050 pin 3 power return ground 只有单点落地显得太单薄,要注意一盎司(oz)铜厚下,10 mil 的落孔只有 0.8a 的承受力,如果是使用十字线接地,就 4 条十字线加起来可承受的电流。宜将地铺大,并多打导通孔与背面的地连通。 注意芯片资料上的 aoz1050 pin 4 pgnd 与 r5 落地的画法,它们是用不同的地符号。意思是说他们建议你用隔离的地(isolation ground),做法上就是 r5 和 pin 4 拉在一起,然后单点落地。 输出应该先过滤波电容 c58、c59 和 c60,再给其它线路,注意到你的输入电容 c56 和 c57 就做得不错,可以参考它的做法。 注意线宽与承载电流的关系,输入与输出线宽需要计算。不晓得 c60 + 号旁边那条细线是做什麽用的?看起来很细。  
布线大原则︰ 让输入或输出滤波电容和地造成的回路越短越好。  
仍需检视的部份︰ l2 电感宜选用有屏蔽(shielding)的封装,避免漏磁(magnetic leakage)干扰。 l2 电感的额定电流(idc1 和 idc2)宜被检视,避免峰值电流(peak current)超过或温度升高,造成电感量不足产生纹波和噪声。 l2 直流电阻(dcr)宜被检视,太高效率不好、容易发热。 aoz1050 pin 5 comp 上的补偿电路,芯片资料上有计算公式,宜试算一下是否搭配得宜。 电解电容 c56 和 c60 的 esr 越小越好,如果您真的很在意纹波及噪声的大小,电解电容尽量选用可靠一点的厂牌。


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