基于VHDL语言对高速A/D器件TLC5510控制的实现
--tlc5510 vhdl控制程序
--文件名：tlc5510.vhd
--功能：基于vhdl语言，实现对高速a/d器件tlc5510控制
--最后修改日期：2004.3.20
library ieee;
use ieee.std_logic_1164.all;
entity tlc5510 is
port(clk :in std_logic; --系统时钟
oe :out std_logic; --tlc5510的输出使能/oe
clk1:out std_logic; --tlc5510的转换时钟
din:in std_logic_vector(7 downto 0); --来自tlc5510的采样数据
dout:out std_logic_vector(7 downto 0)); --fpga数据输出
end tlc5510;
architecture behav of tlc5510 is
signal q:integer range 3 downto 0;
begin
process(clk) --此进程中，把clk 进行4分频，得到tlc5510的转换时钟
begin
if clk'event and clk='1' then
if q=3 then q<=0;
else q=2 then clk1<='1'; --对系统clk进行4分频
else clk1<='0';
end if;
end process;
oe<='0'; --输出使能赋低电平
dout<=din; --采样数据输出
end behaver;
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