利用陷波滤波器的自动调谐电路设计
本设计电路如附图所示，使用ic1(74hc4046pli.锁相环)集成电路芯片，工作频率1mhz.以改善系统的抗噪音度。ic2.一个lsi计算机系统公司生产的rdd104集成电路芯片，在一个8引脚封装中提供1000比1分配器。ic3.混合信号集成的mshn51000比1时钟角落开关电容器高通，陷波滤波器.采用流行的8脚封装。
将ic1的vco(压控振荡器)的输出(vcoo)馈送进ic2的时钟输入，ic2应用div1和div2能完成10、100、1000和100100比l的分配，再将rdd104的输出连接到ic1的coin.通过使用ic1的ex/or相位比较器，能提高抗噪音度。将filter输入信号加在ic1(filter)和ic3(filter)的两者输入端.ic2的clk-out脚驱动ic3的时钟。该mshn5，ic3，具有可选择高通滤波器和可选择陷波滤波器。当你将fsel弓1脚接高电位，它选择陷波.将type接agnd选择狭窄陷波滤波器。此步骤保证从带有信息损耗的输入信号中消除仅有的一个音调。ic3的1000比l时钟角落比率减少失真信号会影响输出的机会。对于话音应用，例如500khz或更高的无信号将可能更名进入通带。一个样品装置在789.13khz的时钟频率，1000倍于输入信号使用789.13mhz的输入频率。该锁相环跟踪输入，将陷波滤波器移动到1.24khz。
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