如何借助Cyclone 10 GX ATX PLL refclk切换实施功能模拟
你知道如何借助cyclone 10 gx atx pll refclk切换实施功能模拟吗？嵌入式流转换器实施atx pll重配置和通道重配置以及实施atx pll和通道再校准呢？想学啊？我（视频）教你啊。
设计中的实例包括：native phy、tx pll、重置控制器，数据和时钟生成逻辑等。两个refclk用于支持，无法通过tx本地除法器实现的两个不同数据速率。125mhz用于2gbps，150mhz用于1.2gbps。
在模拟开始时，收发器以2gbps的数据速率运行，然后使用atx pll refclk切换动态重配置，重新配置为1.2gbps。atx pll refclk切换通过寄存器写操作实施，接着使用嵌入式流转换器进行atx pll重配置和再校准，然后就可以实施cdr refclk切换、通道重配置和再校准了。
温馨提示
在上面的视频中有实施atx pll refclk切换的高级步骤，详情见视频。
在最后的运行模拟示例中，我们可以看到增量数据从tx发送至rx。在启动过程中，收发器通道的运行速率为2gbps。pcs内核宽度为10比特时，tx_clkout频率为200mhz。在实施atx pll refclk切换和通道重配置后，收发器通道的运行速率变为1.2gbps。tx_clkout频率将变为120mhz。这显示atx pll refclk切换和通道重配置已成功完成。
原文标题：参考时钟切换动态重配置不会玩儿？我教你啊
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